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作为一个经常在GPU上折腾性能优化的人，我翻来覆去读得最多的就是《CUDA C++ Programming Guide》里的编程模型那一章。说实话，刚接触CUDA的时候，我一度以为写GPU程序就是把循环拆开扔给一大堆线程去跑，后来发现完全不是这么回事。理解编程模型，是区分“会用CUDA”和“懂CUDA”的分水岭。这篇内容我会结合自己实际踩坑和调优的经验，把编程模型里最容易懵的几个核心概念掰开揉碎讲清楚，包括线程怎么组织、内存怎么布局、核函数怎么写才高效，以及那些官方文档里没写透的底层逻辑。如果你正准备入门异构计算，或者已经在写kernel但总觉得性能不对劲，这篇应该能帮上忙。

1. 编程模型到底在解决什么问题

先把话说在前面：CUDA编程模型的核心，不是教你写并行代码，而是给你一套描述“并行性”的语言和规则。GPU和CPU最大的区别在于，CPU有少量强大的核心，适合跑复杂的控制逻辑；GPU有海量的简单核心，适合跑数据并行的计算任务。编程模型就是在这两者之间搭一座桥，让你能用比较自然的方式，把数据并行的问题映射到GPU的硬件结构上。

我最早犯过的错误，是用写CPU多线程的思路去写CUDA。比如以为开256个线程就相当于CPU的256个线程，其实远远不止——GPU上的线程数量是以万为单位的。编程模型里最关键的一点，是引入了一个分层的线程组织方式：线程（Thread）、线程块（Block）、网格（Grid）。这个分层不是凭空设计的，它是为了匹配GPU硬件的执行模型：线程块被调度到流多处理器（SM）上执行，而线程块内部的线程又以更小的束（Warp）为单位被硬件调度。

理解这个模型，你才能真正回答几个核心问题：一个kernel应该开多少个线程？每个线程处理多少数据？数据应该放在哪一层存储？线程之间怎么同步？怎么通信？这些决策直接决定了你的程序是跑出理论峰值的70%，还是只有5%。

编程模型还定义了一个重要的抽象——异构执行。也就是宿主（Host，通常是CPU）和设备（Device，也就是GPU）协同工作。数据的传输、kernel的启动、内存的管理，都是在这套模型下进行的。官方文档里那句话我一直记得：异构编程模型，核心是让CPU和GPU各司其职。CPU负责串行逻辑、数据准备、任务调度，GPU负责大规模并行计算的部分。

2. 线程组织：网格、块与线程的三级火箭

2.1 为什么要设计成Grid-Block-Thread三层结构

很多初学者不理解，既然线程数量越大越好，为什么不直接把所有线程放在一个扁平的池子里，而要搞出Grid和Block两层容器？这里有两个关键原因。

第一，硬件调度需要粒度。GPU的流多处理器（SM）是物理执行单元，一个SM同时能承载一定数量的线程块和线程。块被分配给SM执行，一个块内部的所有线程在同一个SM上运行。如果把所有线程都放在一个块里，一方面单个SM的硬件资源（寄存器、共享内存）根本装不下那么多线程，另一方面也无法跨SM做调度。块的概念，实际上就是“一次可以调度的作业单元”。

第二，数据局部性和同步需要边界。块内部的线程可以通过共享内存通信，也可以进行同步（块内部的同步）。块与块之间，理论上不能全局同步（除非用协作组或原子操作，代价很高）。这个设计迫使你在写程序的时候，尽量让数据在块内完成交互，减少跨块的依赖，这恰好契合GPU高吞吐并行的特性。

我记得有一段时间，GPU的网格和块还引入了多维的维度——gridDim、blockDim可以是三维的。这个设计主要是为了适配矩阵、图像、体数据这些天然多维的数据结构。你要处理一张二维图像，blockDim就可以设成（16, 16），线程索引用threadIdx.x和threadIdx.y分别对应图像的行列，非常自然。三维的block在处理体素数据时相当好用。

2.2 线程索引的计算：从block到全局ID

写kernel最基础也最容易出错的操作，就是根据threadIdx和blockIdx算出当前线程处理的是哪个数据。这里有个很经典的公式：

int tid = blockIdx.x * blockDim.x + threadIdx.x;

如果是处理二维数据，比如一张宽为width、高为height的图像，你就需要算出全局的像素坐标：

int x = blockIdx.x * blockDim.x + threadIdx.x; int y = blockIdx.y * blockDim.y + threadIdx.y; int pixel_index = y * width + x;

看起来只是乘法加法，但很多人会栽在这里：没做边界检查。因为数据量不一定是blockDim的整数倍。比如你开256个线程，但数据只有1000个元素，最后一次启动的block只有200个线程在干活，剩下的56个线程如果不去判断就直接访问内存，轻则读越界，重则程序崩溃。正确的做法是：

if (tid < N) { // 执行计算 }

这个边界检查是kernel代码里出现频率最高的模式，没有之一。

还有一点值得注意，线程ID的计算顺序影响到内存访问的局部性，进而影响性能。后面讲内存的时候我会详细说，但这里先提一句——尽量让相邻的线程访问相邻的内存地址。公式里用blockIdx.x * blockDim.x + threadIdx.x就是这个目的，它保证了warp内的线程在访问连续数据时是合并的（coalesced）。

2.3 Warp：硬件真正调度的单位

编程模型文档里专门讲到warp这个概念，我觉得这是理解CUDA性能最关键的一环。warp是GPU硬件调度的基本单位，一个warp包含32个线程。也就是说，虽然你在软件层可以指定block中有128个、256个甚至1024个线程，但硬件执行时，这些线程会被切分成长度为32的warp，逐个warp地发射和执行。

这里要理解“锁步执行”这个概念。一个warp里的32个线程，在同一时刻执行的是同一条指令。如果这32个线程走入了不同的分支（比如有的执行if，有的执行else），那么这些分支会被串行执行，不是并行的。这就是所谓的warp divergence（束内分歧）。它的代价非常大，你可能觉得代码在“并行”，但实际上硬件是把每一个分支分别执行一遍，然后让对应的线程掩蔽掉。

我调过一段粒子碰撞的代码，里面有个判断粒子是否超出边界的分支，最初版本的分叉非常严重，性能怎么调都上不去。后来把一个warp内需要走到特殊分支的粒子单独重排，让同一分支的线程尽量聚到同一个warp里，性能直接提升了将近一倍。所以在设计kernel的时候，要尽量避免线程之间的“同花顺”被拆开，让32个线程尽可能走同样的路径。

3. 内存层次结构：性能的秘密全在这里

3.1 从全局内存到寄存器：速度相差百倍

编程模型里专门用大量篇幅讲内存模型，这不是为了凑字数——CUDA程序性能的瓶颈，绝大多数时候不是算力不够，而是内存访问不够快。GPU的存储层次从快到慢依次是：寄存器、共享内存、全局内存（还有只读的常量内存和纹理内存）。它们之间的速度差距是量级的。寄存器基本没有延迟，共享内存的延迟大约是几十个周期，而全局内存的延迟有几百个周期。

我们要做的核心工作，就是尽量让数据在高速存储层次里复用。打个比方，全局内存相当于你从仓库取货，共享内存相当于把货搬到车间的工作台上，寄存器相当于你手里的工具。如果每做一个零件就从仓库跑一趟，效率显然是最低的；如果我们先把一批原材料搬到工作台，在台上完成加工，速度就能快很多。

这也是为什么编程模型里要强调“数据复用”和“访问局部性”——它们都是在教你如何减少对全局内存的访问次数。

3.2 共享内存的使用原理

共享内存是块内所有线程都能访问的高速存储空间，它的生命周期和块绑定。因为它在芯片内部，所以访问延迟远低于全局内存。共享内存最典型的用法是做数据分块（tiling）：把一块数据从全局内存加载到共享内存，然后块内的所有线程反复从共享内存读取数据，计算完成后一次性写回全局内存。

一个非常经典的例子是矩阵乘法。朴素实现每个线程要读两个矩阵的值，能算出很差的性能；而利用共享内存做分块后，可以把这个大矩阵切成小块，每个线程块负责一个输出小块。加载时协作把输入子块读入共享内存，计算时全部从共享内存读，这样对全局内存的访问量大幅减少，性能可以提升一个数量级以上。

用代码来概括一个使用共享内存的矩阵分块乘法框架：

__global__ void matrixMulKernel(float* A, float* B, float* C, int n) { __shared__ float As[TILE][TILE]; __shared__ float Bs[TILE][TILE]; int bx = blockIdx.x, by = blockIdx.y; int tx = threadIdx.x, ty = threadIdx.y; int row = by * TILE + ty; int col = bx * TILE + tx; float sum = 0.0f; for (int k = 0; k < n / TILE; ++k) { As[ty][tx] = A[row * n + k * TILE + tx]; Bs[ty][tx] = B[(k * TILE + ty) * n + col]; __syncthreads(); for (int i = 0; i < TILE; ++i) { sum += As[ty][i] * Bs[i][tx]; } __syncthreads(); } C[row * n + col] = sum; }

注意代码里有两次__syncthreads()。第一次是确保加载完成后再开始计算，第二次是确保所有线程计算完成后，再进入下一轮加载，避免前面的线程把共享内存覆盖掉。

3.3 全局内存的合并访问

全局内存还有一个非常容易踩的性能坑——合并访问。GPU对全局内存的访问是以缓存行/扇区为单位的，如果一个warp里的32个线程访问的是连续的一段内存地址，那么硬件可以用一次事务把它取回来；如果32个线程访问的是跳来跳去的地址，硬件就要拆成很多次事务。

官方编程模型文档里有个经典的说明：同一个warp内的线程，访问连续的内存地址时效率最高。这句话的实践含义是：在设计数据布局的时候，要让线程ID和内存地址的映射尽量线性、连续。

我遇到过一种性能极差的情况：数据结构是“数组的结构体”（AoS），比如每个元素是一个包含x、y、z坐标的结构体，而程序需要并行处理所有元素的x坐标。线程访问x坐标时，地址跨度是结构体的大小，整个warp访问的内存被拉扯得稀碎。改成“结构体的数组”（SoA），把x坐标存成一个单独的数组，warp内的线程访问连续地址，全局内存访问效率一下就上来了。编程模型里没有直接教你数据布局，但对内存访问模式的理解，会反过来指导你的数据布局设计。

4. 核函数（Kernel）写法和启动配置要点

4.1 核函数的约束和习惯

在编程模型章节里，文档给你定义了核函数的基本语法。用__global__修饰的函数就是核函数，它由宿主端调用，在设备端执行。写核函数有几个硬约束：

• 核函数不能返回值，只能是void；
• 核函数的参数传递是通过寄存器和常量内存完成的，参数不要太大；
• 核函数不能调用宿主的普通函数，只能调用设备端函数（__device__修饰）；
• 核函数之间可以异步启动，但同一个流（stream）里的核函数是串行执行的。

举一个简单例子——向量加法：

__global__ void vecAdd(float* A, float* B, float* C, int n) { int i = blockIdx.x * blockDim.x + threadIdx.x; if (i < n) { C[i] = A[i] + B[i]; } }

调用方式：

int threads = 256; int blocks = (n + threads - 1) / threads; vecAdd<<<blocks, threads>>>(d_A, d_B, d_C, n);

注意<<<blocks, threads>>>这种尖括号语法。第一个参数是网格大小，第二个是块大小。这是一个非常容易扩展的模型：因为块会被调度到不同的SM上，所以只要你的程序逻辑不依赖于块与块之间的执行顺序，它就可以从只有几个SM的小GPU一直扩展到几十个SM的大GPU，而不需要改代码。

4.2 启动配置的权衡

那块的尺寸应该怎么选？编程模型文档的建议是，blockDim最好是32的倍数，这可以保证整数个warp。经验上64到512之间都算比较常见的选择。块太小（比如32）会导致每个SM上的block数量太多，调度开销增加；块太大（比如1024）又会限制一个SM上同时驻留的block数，占用寄存器也会更多，导致并发度下降。

决定一个SM上能同时驻留多少线程的因素，不只是线程数量本身，还有每个线程占用的资源——寄存器数量、共享内存大小、block数量上限。这些资源是SM的硬约束。所以启动配置本质上是一个在资源约束下求最大并发度的优化问题。

我自己调参时的一个经验：先把block设为256，256是CUDA的默认舒适区，然后看两个指标——占用率（通过Nsight Compute看warp occupancy）和访存效率。如果程序是计算密集型的，提升寄存器分配会让kernel跑得更快；如果是访存密集型的，重点就放在合并访问和共享内存上。盲目追求block大小其实意义不大，关键还是要看资源瓶颈在哪里。

4.3 同步与原子操作：从并行到协作的代价

编程模型里特别强调同步。块内的同步用__syncthreads()，这是逻辑上必须的——因为一个块内线程有时需要等待其他线程完成某个阶段的工作，然后才能安全继续。但有一个容易忽略的事实：__syncthreads()会强制warp之间的执行同步，如果block内线程数量不是一个warp的整数倍，最后一个不完整的warp会导致死锁。所以块大小设为32的倍数并不是可选项，几乎算是硬性要求。

另一种情况是块之间的同步，CUDA没有提供内核内的全局同步原语。如果你希望两个块之间数据有依赖，通常的解决办法是：启动两个kernel，前一个把数据算完，写回全局内存，后一个再读取。这看起来浪费了一次kernel启动的开销，但这是一个刻意的设计——通过kernel边界天然完成全局同步，避免了在GPU内部做全局同步的巨大开销。

原子操作也是编程模型里一定要知道的东西。比如多个线程累加同一个全局变量，必须用atomicAdd。原子操作虽然方便，但代价是——同一时刻只有一个线程能修改目标变量，其他线程在这个地址上排队。如果大量线程同时争抢同一个地址（比如把整个数组加到一个总和变量），性能会急剧下降。我在做归约的时候，通常先让每个block在共享内存里做局部归约，得到一个block级的局部和，然后再用原子操作把这些block级数值合并成最终结果。这样原子操作次数就降低到block的个数，效率能好很多。

5. 实际操作中的编程模型调试经验与常见坑

5.1 如何用NSight和错误检查定位问题

写CUDA程序，最让人头疼的问题不是编译错误，而是逻辑无误但结果错误或者性能莫名其妙地差。这时候你需要几件趁手工具。

首先是错误检查。CUDA的很多API和kernel调用是异步的，也就是你调用完kernel，错误不一定立刻返回。正确的做法是在每次kernel调用后加上错误检查：

cudaError_t err = cudaGetLastError(); if (err != cudaSuccess) { fprintf(stderr, "CUDA error: %s\n", cudaGetErrorString(err)); }

内核启动失败、内存访问越界会通过这个方式暴露出来。实际项目中我一般封装一个宏，比如CUDA_CHECK，在每次API调用后检查返回值。这看着麻烦，但真的能救命——很多莫名其妙的问题都是越界访问把显存搞坏了。

然后是性能工具。Nsight Compute是性能分析的利器。它能看到kernel的占用率、内存吞吐、寄存器溢出、warp状态等。我最常看的几个指标是：Compute (SM) Throughput、Memory Throughput、Achieved Occupancy。通过这几个数字，能很快判断程序是计算瓶颈还是访存瓶颈。

5.2 常见的性能坑

寄存器的bank conflict：共享内存虽然快，但如果多个线程在同一时刻访问同一个bank（共享内存的物理分区）里的不同地址，会产生bank conflict，导致访问被串行化。这个坑在共享内存用的多的时候非常常见。解决思路一般是调整数组的存储布局或者填充（padding）—比如把二维数组的行宽从16改成17，就能避开bank冲突。这个技巧看起来有点玄学，但实际效果常常是立竿见影的。

寄存器溢出（spill）：如果一个线程需要的寄存器数量超出硬件限制，剩余的部分会被“溢出”到局部内存。局部内存在硬件上放在全局内存里，访问速度暴跌。这种情况在kernel写的特别复杂时容易出现。遇到这个情况，优先减少每个线程的局部变量，或者缩小block大小，实在不行才去改编译选项。

过度使用原子操作：前面提到过，全局原子操作是争抢的，争抢越激烈，程序越慢。如果你发现kernel里大量线程频繁对一个全局数组做原子操作，那一定要重构——先用共享内存做局部聚合，再合并。

主机和设备之间的数据传输：很多人忽略了内存拷贝的代价。数据从主机传到设备，再拷贝回来，需要经过PCIe总线，带宽通常是几十GB/s的量级，相比设备端的显存带宽（几百GB/s到数TB/s）差了一个数量级。编程模型也提醒你：尽量在设备端完成所有数据操作，减少往返拷贝。如果你有一个循环，每次迭代都要把数据拷贝回主机处理，那就要考虑把循环整个搬到kernel里。

5.3 关于编程模型思维方式的建议

最后说点个人体会。学CUDA编程模型，最关键的一步是把思维方式从“指令的顺序执行”转换到“数据的并行流动”。CPU编程时你关心“代码的执行路径”，CUDA编程时你更应该关心“数据在各级存储之间怎么流动、被多少个线程访问了几次”。

编程模型的每一层抽象——线程、块、网格、存储层次、内存一致性——都是一次资源和控制模式的权衡。它不像普通C++代码那样可以靠编译器帮你把所有细节都处理掉，很多时候这些映射关系是直接暴露给你，由你来决定怎么利用。

我不建议一上来就背API列表，而是先拿一个最简单的例子（比如向量加法、矩阵乘法）亲手敲一遍，然后用Nisight去观察：调整grid和block大小，看看性能曲线怎么变；把数据布局从AoS改成SoA，再看看访存指标怎么变；加一段共享内存的tiling逻辑，看看吞吐量怎么涨。把这些观察和编程模型对应起来，你对CUDA的理解会迅速走上正轨。

我后来带过几个新人，最有效的学习路径就是：写一个矩阵乘法，从朴素版，到共享内存分块版，再到优化访问模式版，每一步对照Nsight指标看变化。走完这一遍，编程模型那章就不用回头再看了，因为那些概念全都变成了你自己的操作习惯。