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简介：半桥LLC谐振变换器设计与仿真PPT课件面向电力电子专业学生及电源工程师，系统讲解谐振变换器技术、LLC变换器工作原理与Saber仿真验证方法。内容从SRC、PRC、SPRC三种拓扑切入，对比各自直流特性与软开关实现条件，指出SRC轻载调频范围大、PRC关断损耗高等局限，并解释LLC如何结合二者优势，实现全负载范围内的ZVS。课件重点剖析两个谐振频率下的工作模态（M1-M3），说明激磁电流如何为开关管创造零电压开通条件，副边整流管如何实现ZCS关断，同时演示在Saber中搭建模型、设置参数与分析波形的完整思路。压缩包共1个文件，为9.43MB的演示文稿，幻灯片结构完整，包含理论推导、特性曲线、模态示意图与仿真结果分析，适合课程学习、毕业设计或项目预研参考。该课件已有210人学习，对照PPT即可演练LLC仿真流程，是入门谐振变换器与Saber仿真的实用资料。

1. 拿到“半桥LLC设计与仿真”需求后，我建议按这条路线走

你手上这份半桥LLC谐振变换器设计与仿真PPT，大概率不是什么可运行源码包，而是一组公式、波形和参数建议的骨架。它把拓扑结构、增益曲线和设计流程摆清楚了，但真正动手时会发现：公式里每个字母和实物之间的对应关系、仿真里哪些波形能信、哪些只是看起来对，PPT很少写透。本文就按一个电源工程师从需求到闭环仿真验证的路线来讲：先把LLC区别于普通PWM变换器的底层逻辑说清，再给一套可直接落地的谐振参数计算流程，然后讲怎么在PSIM这类工具里搭出能复现的闭环仿真，最后聊我没少踩的坑。

2. 半桥LLC的核心原理：PFM与三个谐振工作区

2.1 为什么LLC要用PFM控制：先搞懂增益从哪来

LLC谐振变换器的功率级由半桥逆变单元、谐振槽和副边中心抽头整流器组成。和普通PWM DC-DC不同，LLC的输出电压不是靠占空比调节的，而是靠开关频率调节：当开关频率等于串联谐振频率fr时，谐振槽阻抗最低，增益接近1；频率偏离fr时，谐振槽阻抗变化，增益随之变化。这种增益随着频率变化的特性来自Lr、Cr、Lm三个元件的阻抗关系，其中Lr和Cr决定串联谐振点，Lm参与低频段的增益抬升。所以你翻PPT时看到的增益曲线，本质是“频率作为控制量，谐振槽作为比例器”，理解了这一点，后面所有参数设计都有了参照系。

LLC能在很宽的负载范围内实现原边开关管ZVS，正是因为正常工况落在感性工作区，谐振电流相位滞后于桥臂中点电压，开关管体二极管先续流，把开关管端电压钳到零。这时候开通开关管，电压已经为零，开通损耗趋近于零。这就是LLC效率高的核心原因，也是它和硬开关PWM变换器最本质的区别。半桥结构只有两个原边开关管，适合中等功率场合，常见做法是把Lr做成独立谐振电感或变压器漏感，Lm就是变压器励磁电感，副边采用中心抽头全波整流。

2.2 半桥和全桥怎么选：一份PPT不会直说的边界

半桥LLC的桥臂中点输出方波电压幅值等于输入电压的一半，开关管承受的电压应力是输入母线电压，而全桥每个开关管只承受一半输入电压。这个差异决定了半桥适合输入电压不太高、输出功率中等的情况。我一般把300W到1.5kW划给半桥，超过这个功率范围，原边电流应力大、变压器利用率不够，全桥更划算。

功率级还有一个容易被忽略的细节：半桥的励磁电流和负载电流都流过同一个桥臂，导致无功分量相对大一些，但轻载效率反而更占优势。如果你做的是400V输入、48V/20A这种规格，半桥是首选，器件成本和复杂度比全桥低，还能保留LLC的软开关优势。PPT里如果给出半桥拓扑和设计公式，默认就是这类中功率应用，做仿真时开关管选型也要按这个应力来定。

2.3 三个谐振工作区和ZVS的边界

LLC谐振槽有两个特征频率：fr1由Lr和Cr决定，是串联谐振点；fr2由Lr、Cr、Lm共同决定，是第二个谐振点。功率变换的主要增益段按频率从高到低分三个区域：频率远高于fr1时，谐振槽呈感性，增益小于1，适合高压输入；工作频率在fr2与fr1之间时，谐振电流滞后，原边ZVS且副边整流二极管基本为零电流关断，这是最常见的满载工作区；频率低于fr2后进入容性区，电流超前，开关管硬开通，波形畸变、噪声明显增加。

我自己看增益曲线时只看两点：满载最高增益点是否落在感性区，轻载最低增益点是否接近1。如果任何一点跑到容性区，这个设计的边界就有问题。另一个实用判断是看谐振电流波形：感性区电流波形正弦度好、过零点干净；容性区电流会出现明显换向畸变，甚至桥臂中点电压跌落。这个习惯比背公式管用得多，仿真里一眼就能看出来。

3. 谐振参数设计：一套能直接抄作业的计算流程

3.1 先定规格和匝比：别一上来就算电感

设计LLC的第一步不是算Lr，而是确定变压器的原副边匝比。匝比由输入母线电压、输出电压和整流压降共同决定。半桥的桥臂中点电压幅值是Vin/2，在谐振频率附近增益接近1，所以匝比n可以按n等于Vin/2除以副边输出电压来估算。注意这里要留出整流管的压降，副边用二极管时按0.8到1V估算，用同步整流时按0.3到0.5V估算。

以400V标称输入、48V输出的规格为例，Vin/2等于200V，副边电压取48.5V，算下来n约等于4.1，取整到4。匝比定错会导致满载增益点偏离，后面再调Lm都救不回来。定完匝比再看输入范围：如果输入最低到350V，最高到420V，增益需求范围就出来了，这个范围决定了你Lm和Q取值该往哪个方向调，而不是凭感觉凑参数。

3.2 三参数速算脚本：k和Q先定，元件值后算

Lr、Cr、Lm三个元件值只有两个独立自由度，工程上习惯先定义k等于Lm除以Lr，再定义满载品质因数Q，然后反推三个元件值。k通常取3到5，Q取0.3到0.5。fr按应用场景选，中功率电源最常见的是100kHz左右，频率越高磁件越小，但驱动损耗、死区损耗和PCB布局难度同时上升。下面这个脚本可以直接跑，逻辑完全不依赖具体软件版本。

# 半桥LLC谐振参数快速计算脚本 import math # 输入规格：母线电压与输出电压 Vin_nom = 400.0 # 标称输入电压 V Vin_min = 350.0 # 最低输入电压 V Vin_max = 420.0 # 最高输入电压 V Vout = 48.0 # 输出电压 V Iout = 20.0 # 输出电流 A Vd = 0.5 # 副边整流二极管压降 V # 设计自由度 fr = 100e3 # 串联谐振频率 Hz k = 4.0 # Lm / Lr 比值 Q = 0.4 # 满载品质因数 # 匝比估算：半桥中点电压 = Vin/2，谐振点增益约 1 n = round((Vin_nom / 2.0) / (Vout + Vd)) # 反射到原边的等效交流电阻 Rload = Vout / Iout Rac = 8.0 * n * n * Rload / (math.pi ** 2) # 反推谐振元件值 Lr = Q * Rac / (2 * math.pi * fr) Cr = 1.0 / ((2 * math.pi * fr) ** 2 * Lr) Lm = k * Lr # 验证增益范围：G_min 对应最高输入，G_max 对应最低输入 G_min = n * (Vout + Vd) / (Vin_max / 2.0) G_max = n * (Vout + Vd) / (Vin_min / 2.0) print(f"匝比 n = {n}") print(f"Rac = {Rac:.2f} 欧姆") print(f"Lr = {Lr * 1e6:.2f} uH") print(f"Cr = {Cr * 1e9:.1f} nF") print(f"Lm = {Lm * 1e6:.2f} uH") print(f"增益范围: {G_min:.3f} ~ {G_max:.3f}")

这段脚本的输出结果是匝比n等于4，Rac约31.2欧姆，Lr约19.9微亨，Cr约127.4纳法，Lm约79.6微亨，增益范围0.924到1.109。Rac的公式里，8除以π平方是半桥LLC方波激励到正弦谐振的折算系数，n平方是原副边阻抗反射，Rload是纯阻性满载。Q取0.4意味着满载时谐振槽阻抗只有等效电阻的0.4倍，增益曲线上看就是满载增益点离开谐振点不太远，留了容性区安全裕量。

3.3 三个元件的取值逻辑：每个参数都有代价

Lr直接限制谐振电流的变化率，Lr越大谐振电流变化越慢，ZVS能量越充沛，但Lr过大会导致增益曲线变陡，频率调节范围变窄。Cr承担谐振电容的电压应力，半桥中Cr两端会有母线电压一半的直流偏置叠加谐振交流分量，耐压按实际应力加50%以上裕量选。Lm的取值是最需要权衡的：Lm越大励磁电流越小，轻载损耗越低，但Lm太大会导致死区时间里没有足够电流完成开关管结电容的充放电，丢掉ZVS。

我一般用死区时间去约束Lm上限。半桥LLC死区内，Lm电流近似恒流给开关管Coss放电，放电电流约等于Vin除以4倍Lm乘开关频率，死区时间tdead要大于2倍Coss乘Vin除以这个电流，否则ZVS条件不满足。按100kHz、400V、典型MOSFET的Coss约300皮法估算，Lm取80微亨上下没问题，死区定在150到300纳秒都有裕量。如果Coss更大，就把Lm往下调，或者把死区加长。这个约束关系很多人会漏掉，等到实测发现开关管升温才回头查。

4. 用 PSIM 搭出可复现的半桥 LLC 闭环仿真

4.1 功率级搭建顺序：一条主链串联到底

在PSIM里搭半桥LLC的功率级，我的习惯是从直流母线往负载方向一个模块一个模块接，不要跳着摆。首先是直流电压源Vdc，接两个带体二极管的MOSFET组成半桥桥臂，桥臂中点引出接Lr，Lr后面串Cr，Cr后面接一个由Lm并联理想变压器原边组成的网络，理想变压器副边中心抽头接两个二极管到输出电容和负载。Lm放在变压器原边并联位置，Lr放在桥臂中点和Lm之间，Cr位置在Lr和Lm之间，这个顺序能正确体现LLC的谐振槽结构。

一个关键点是变压器建模。常见做法是用理想变压器加外部Lr和Lm。不用纠结漏感耦合系数这类模型细节，Lr单独放一个电感，Lm并联在理想变压器原边，这样参数和计算值完全对应，排查波形时也直观。副边整流管先用力宏模型MOSFET内建体二极管或者快恢复二极管模型都可以，但压降参数要设置准确，仿真里的压降偏差会直接反映到输出电压误差上。

搭建完成后的基本检查项是：桥臂中点电压波形是不是约50%占空比方波、Lr电流是不是正弦状、Cr电压有没有明显直流偏置。开环先固定频率跑一下最好，刚开始合环容易把问题绕在一起。我列一张典型参数表方便直接对照。

4.2 闭环控制：VCO做频率调制，电压外环做调节

LLC闭环控制的核心模块是压控振荡器，也就是VCO。误差放大器把输出电压采样和参考电压比较，输出一个误差电压信号，VCO把这个电压映射成开关频率。PSIM里设置VCO时要给定中心频率和增益，中心频率定在谐振频率附近，增益决定了整个环路的调节灵敏度。频率范围限制一定要加，否则环路动态时频率掉进容性区，仿真就会看到波形发散或开关管高压应力。

我建议先把VCO设置成开环固定频率90kHz跑一次功率级，确认输出电压和电流波形正常，再接闭环。这样万一波形不对，你能分清是功率级参数问题还是环路参数问题。闭环的PI参数先用小比例增益加一个小的积分时间，慢慢增大比例增益，观察输出电压动态响应是否稳定。比例增益过大会引起频率快速摆动，波形会出现明显的电流包络振荡，这就是进入了临界不稳定状态。

闭环仿真的另一个检查点是启动瞬间。LLC在启动时频率会从较高值往工作频率过渡，常见做法是给VCO一个初始高频偏置，让启动频率从1.5倍fr附近开始，再慢慢降到额定工作点。这个动作相当于软启动，限制启动冲击电流。你可以用斜坡信号源接VCO控制端，斜坡时间定在5到10毫秒，观察谐振电流包络是否有大尖峰。

4.3 仿真里判定ZVS和增益对不对：看波形不看数字

很多人在仿真里只看效率数字和输出电压，这其实容易误判。判定原边ZVS有一个很直接的方法：看驱动信号上升沿之前，桥臂中点电压是不是已经降到接近零。如果管子开通前电压已经为零，说明体二极管先续流完成了Coss放电，这是真ZVS；如果开通瞬间电压还在高位，波形上就会看到明显的开通尖峰，那就是硬开关。另一个检查点是看Lr电流在死区内的方向，ZVS成立时电流在这个窗口内保持续流方向不变，并且幅值足够完成放电。

增益对不对则看输出满载时的工作频率。用闭环仿真跑额定工况，看VCO输出的稳态频率和设计预期的关系。如果满载频率明显低于fr，说明增益点偏低，要减小Q或调大k；如果满载频率高得离谱，说明增益点偏高，甚至可能工作在容性区边缘。这个频率读数比看输出电压可靠得多。仿真里可以加一个平均频率表或直接看控制电压换算，实际样机调试时用示波器测开关频率来核对。

扫频验证我放到最后一步讲，但仿真阶段也可以先做：把电压环断开，VCO直接接斜坡信号从150kHz扫到60kHz，记录每个频率点的输出电压，和设计增益曲线对一下。这一步能提前发现参数设计错误，不用等到样机出来再后悔。

5. 半桥 LLC 的 5 个高频踩坑点：从仿真到样机

5.1 Cr直流偏置没设初始值，开环波形“看起来不对”

现象：开环仿真跑出来后，Lr电流正负半周不对称，Cr电压波形明显飘移，输出电压也不对。

原因：LLC稳态时Cr两端有约等于母线电压一半的直流偏置电压，但仿真器默认电容初始电压为零，前几十个周期会被迫建立一个直流工作点，如果观察窗口太短，看到的都是过渡过程。

解决：在Cr上设置初始电压Vin/2，或者直接把仿真时间拉长，等稳态之后再截取波形。PSIM里给电容赋初始值即可。跑LLC仿真我习惯先跑200微秒再开始看波形，避免拿启动段做判断。

5.2 死区时间设短了，ZVS悄悄丢失但没人发现

现象：满载时输出电压正常，效率数字也算好看，但开关管壳温明显偏高，关断波形有振铃。

原因：死区时间小于Coss充放电所需时间。LLC的ZVS是靠死区里Lm电流给开关管结电容放电实现的，死区太短放电没完成，开通瞬间变成硬开关。

解决：按Lm电流和Coss重新核算死区时间。常见做法是死区取谐振周期的1%到2%，100kHz下就是100到200纳秒，然后看桥臂中点电压波形确认开通前确实降到零。这个波形确认动作每换一次MOSFET型号就要重做一次，因为Coss变了。

5.3 频率下限没限制，环路扰动时掉进容性区

现象：负载阶跃或输入突变时，谐振电流突然出现畸变，开关管电压尖峰变大，甚至仿真报错发散。

原因：VCO频率下限设置过低，环路为了拉高增益把频率压到fr2以下，整个系统进入容性工作区。容性区的LLC已经不具备ZVS条件，却还按ZVS逻辑控制，自然翻车。

解决：给VCO设置频率下限，一般取0.8倍fr，保守一点取0.85倍fr。同时用深度钳位限制误差放大器的输出范围，防止饱和时把频率推得过低。这个坑在PPT里通常只写“避免容性区”，但真正落地的就是这两个限幅设置。

5.4 PPT里的参数和仿真对不上：先查匝比定义和折算基准

现象：按PPT给出的元件值搭电路，开环输出和PPT波形差距很大，谐振电流幅值也不对。

原因：最常见的三个分歧点是匝比定义方向不一致、Lr是否包含变压器漏感、副边整流压降没折算。不同资料来源的n定义可能恰好互为倒数，Lr放在原边还是折算到副边也完全不同。

解决：拿到参数先列一张换算清单，统一折算到原边参考系。匝比写清楚是原边比副边还是反过来，漏感值确认是不是已经包含在Lr里，整流压降按实际二极管型号查表后折算。这套动作做下来，绝大部分“参数对不上”的问题都消失了。

5.5 副边同步整流时序不当，效率虚高或者波形诡异

现象：副边用同步整流MOSFET时，体二极管一直导通，效率数字反而比预期高，或者开关波形上看到异常的负压尖峰。

原因：同步整流管的开关时序必须和原边驱动严格配合，时序错了要么副边管子长时间体二极管续流，要么出现共通短路。仿真里的MOSFET模型如果没有正确设置体二极管和驱动逻辑，输出波形就会失真。

解决：先用二极管整流把功率级跑通，确认谐振参数和控制环路没问题后，再把副边换成同步整流管并加入时序逻辑。验证时序是否正确的标志是：副边MOSFET的体二极管在每个开关周期内只短暂导通，大部分电流走沟道。这个顺序能帮你隔离功率级问题和控制问题。

6. 我常用的两道最后工序：启动仿真与扫频验证

6.1 闭环启动仿真：频率做软启动，观察冲击包络

每版参数我都先跑一次闭环启动仿真，这项检查的重点是谐振电流的包络峰值和输出电压过冲。把VCO初始频率设在1.5倍fr左右，让频率在5到10毫秒内斜坡降到工作点，启动电流会在几个周期内达到峰值。如果这个峰值超过稳态电流的3倍，说明启动频率太低或斜坡太快。常见做法是把初始频率拉高到2倍fr，斜坡时间拉长一倍，代价只是启动时间多几毫秒。启动仿真的另一件事是看输出电压过冲，LLC的增益调节能力有限，启动阶段输出电压冲过头说明环路积分太快，把PI积分时间调大一档再跑一遍。

6.2 扫频法验证实际增益曲线

断开电压环，让VCO直接接受一个斜坡信号驱动频率从150kHz扫到60kHz，每个频率点跑足够长的时间到稳态，记录输出增益，再把设计时算出的最低和最高增益需求画成两条水平线。如果实际增益曲线的最大值低于G_max这条线，满载就达不到输出电压要求；如果最低点还高于G_min，轻载时输出电压会偏高。这两条线一画，参数设计合不合理一目了然。这个方法不只适用于仿真，样机调试时同样可以做，只是扫频方式换成信号源或控制指令。实测时注意频率步进要小，每点停留时间要足够让输出稳定，否则画出来的曲线全是毛刺。

说实话，扫频验证是我吃过亏之后才养成的固定工序。某次我为了省磁件成本把k从4改成6，满载效率确实好看了不少，但半载工况直接掉进容性区，负载切换时输出电压开始振荡，波形排查了好几天。从那以后，每版参数交付前我都会先扫出一条实际增益曲线，确认最高增益点、最低增益点和三个工作区的位置都对得上，才敢往样机上放。这套工序看着啰嗦，但能省掉后面所有排错的时间，希望帮到你。

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