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1. 为什么我为一个“老掉牙”的矩阵乘法写了个专用库

如果说有哪种计算，十年前只待在HPC论文里，今天却撑起了整个深度学习软件栈的底层，那非矩阵乘莫属。线性层是矩阵乘，注意力打分是矩阵乘，卷积用im2col变换后还是矩阵乘。你训练一个Transformer、跑一次推理、做一次微调，底层几千上万个算子同时在干的，其实是同一件事：算GEMM。

DeepGEMM这个名字听着唬人，拆开看就是Deep Learning + GEMM。我最早做这个项目的动机特别朴素：某次跑模型时发现GPU利用率忽高忽低，profiler里大量时间被卡在矩阵乘法相关的kernel上。厂商自带的BLAS库已经很快了，但针对特定形状、特定精度、特定硬件做定制化优化时，通用库总有那么点“不够聪明”的别扭劲。于是我做了一个专门为深度学习场景优化的GEMM计算内核和配套调度方案，顺便把整个调优思路完整踩了一遍。这篇文章就是这次实践的完整记录。

如果你刚接触高性能计算，这篇内容可以帮你理解GEMM为什么难、怎么优化、怎么排查；如果你已经在写kernel，这篇文章能提供一套可以直接拿去用的参考实现、参数范围和避坑清单。总之，这不是一篇泛泛讲“矩阵乘法很重要”的科普，而是一篇按真实项目流程走下来的实操笔记。

1.1 模型训练变慢，瓶颈往往在矩阵乘

我们习惯把深度学习性能问题归咎于框架调度、Python开销或显存带宽，但真实profiling样本里，绝大多数训练step的时间消耗在少数几个GEMM kernel上。例如一个标准的Transformer层包含多个线性映射和注意力得分计算，这些操作本质上都是对某个三维张量做批量矩阵乘。

我之前在某个项目中遇到这样一个现象：模型结构本身不大，但每次step时间明显超过理论估算。一开始怀疑是数据加载慢，查了半天发现数据管道很健康；后来怀疑是算子融合不到位，结果发现框架已经做了不少融合；最后打开kernel级profiling，才看到罪魁祸首是某个特定形状的矩阵乘kernel整体利用率不到30%。通用库的kernel是为“平均情况”设计的，它会尽量覆盖各种形状、各种对齐、各种精度组合，但针对具体场景，它的分块尺寸、线程映射、流水线深度未必是最优的。

DeepGEMM的思路就是在这种背景下确立的：不做覆盖所有情况的万能库，而是针对深度学习中最常见的那一类矩阵乘形状和精度，把每一份算力都榨干。

1.2 DeepGEMM 到底解决什么问题

先明确应用场景。深度学习里的矩阵乘有三个显著特征：一是M、N、K三个维度经常不是整齐的倍数，带padding的、非对齐的形状特别多；二是精度需求灵活，训练常用BF16混合精度，推理可能用FP16或INT8，不同精度对硬件指令的利用方式完全不同；三是调用频率极高，一个batch训练可能包含几十上百次GEMM，哪怕单次只提升5%，累积收益也相当可观。

DeepGEMM瞄准的目标非常具体：在一块典型的现代GPU上，针对FP16/BF16输入、FP32累加的混合精度矩阵乘，在没有厂商闭源黑魔法的情况下，通过合理分块和指令级优化把算力利用率推到80%以上。同时，代码要足够清晰，让人能看懂每个优化步骤的意图，而不是一个神秘的黑盒。

我见过太多性能优化项目最后陷入“为了优化而优化”的境地，代码改得又臭又长，性能却只涨了几个百分点。DeepGEMM的边界设定从一开始就很明确，只做必要优化，不追求极限玄学，让每个改动背后都有数据支撑。

2. 先算清楚：GEMM 为什么慢，瓶颈到底在哪

很多人以为GEMM慢是因为计算量大，这句话只对了一半。计算量大是事实，但现代GPU的峰值算力非常恐怖，真正让你跑不到峰值的原因，往往是数据喂不饱计算单元。这个问题不先想清楚，后续所有调优都是瞎忙。

2.1 拆解一次矩阵乘：算力与访存的赛跑

矩阵乘C=M×N的每个输出元素是A矩阵一行和B矩阵一列的点积。如果按照最朴素的方式，把A中的每个元素读出来乘以B中对应元素再累加，那么每个浮点运算几乎都伴随一次全局内存访问。全局内存带宽和计算单元的吞吐差距有多大呢？以一张常见的加速卡为例，峰值算力每秒可以完成数百万亿次浮点运算，而显存带宽每秒只能搬运数TB数据。如果每次运算都依赖全局内存，计算单元大部分时间都会空转等数据。

这里有个关键指标叫“计算强度”，即每字节数据搬运能支撑多少次浮点运算。只有当计算强度高于硬件本身的平衡点时，计算单元才能跑满。GEMM的优化本质上就是不断提高这个强度，让每个从显存搬进来的数据被反复使用更多次。

我把这个过程类比成一个后厨场景：厨师（计算单元）处理食材的速度极快，但食材放在很远的大仓库（全局内存），每次取菜都要跑很远。如果每次炒菜需要什么就去仓库拿什么，大部分时间都浪费在路上。聪明的做法是一次搬一筐菜放到灶台边的备菜台（共享内存），甚至直接在手里（寄存器）处理多个菜的工序。

2.2 内存带宽与计算强度的关系

GEMM的计算强度可以通过分块来量化。假设我们把A矩阵分成BM行、BK列的小块，B矩阵分成BK行、BN列的小块，那么这两个小块分别从全局内存加载一次，就能计算出BM×BN个输出元素。此时总共搬入的数据量是BM×BK + BK×BN个元素，计算量是2×BM×BN×BK次浮点运算，计算强度就是两者的比值。

从公式可以看出，BM和BN越大、BK越小，计算强度越高。乍一看无限增大BM和BN就完事了，可惜硬件不答应。共享内存容量有限，寄存器数量有限，线程块调度也有限制，所以分块必须在硬件资源约束下寻找最优解。这也是GEMM优化的核心主线之一。

2.3 精度选择：FP16/BF16 和 Tensor Core 的机会

深度学习常用的两种半精度格式让我在性能上有可观的增益：FP16精度范围较小但数值密度高，BF16的精度范围回到FP32水平但尾数位少。硬件设计上还有一个大杀器叫tensor core，它在单个指令周期内能完成4×4甚至更大的矩阵乘累加操作，吞吐量远超普通CUDA核心。但要触发这个能力，数据格式、存储布局都有严格要求。

DeepGEMM一开始就把精度路径定为FP16/BF16输入、FP32中间累加，因为这个组合在深度学习训练中最常见。使用tensor core时，数据通常需要满足特定对齐要求，不够对齐的形状还得考虑padding策略。这些不是“锦上添花”的优化，很多加速卡的混合精度算力上限就体现在这里，不用tensor core的话，这辈子都跑不满峰值。

3. DeepGEMM 核心设计：分块、流水、算力榨干

理解了瓶颈之后，DeepGEMM的架构设计就顺理成章了：优先解决数据搬运问题，再解决指令效率问题。整个内核设计的核心可以用三句话概括：分块让数据局部化、流水线让搬运和计算重叠、tensor core让单次指令干更多活。

3.1 分块策略：让数据飞起来

先说分块。我最终选择的主分块尺寸是128×128，即每个线程块负责计算输出矩阵中128行、128列的一个区域。K维方向的子块尺寸设为16或32，根据精度和硬件tensor core能力动态调整。为什么不是64×64或256×256？太小的话，计算强度不够，数据搬运开销占比太高；太大的话，共享内存放不下那么多分块数据，还会让一个线程块占用的资源过多，降低并发度。

这里有一个平衡点需要在实际设备上验证。我实测过在不同GPU上，128×128配合K方向16或32的分块，整体性能和资源占用最均衡。如果共享内存充裕且寄存器压力可控，可以尝试更大的128×256，但收益未必正比于体量增长，因为更大的分块会导致线程块内同步次数增加和调度灵活性下降。

分块确定后，线程映射也顺理成章。我把线程块内部的128×128输出区域按8×8的微块划分，每个线程负责8×8=64个输出元素，这样4×4的tensor core指令正好完成一次微块的计算。线程数控制在256个，既能保持足够的并行度，又不会过多占用寄存器资源。

3.2 共享内存与寄存器级的双重缓存

数据从全局内存到计算单元，中间要经过共享内存和寄存器两道“缓存”。朴素实现是从全局内存直接读数据，慢；改进版本先进共享内存，快了一些；终极版本是数据在共享内存和寄存器之间流水式流动，让加载和计算同时进行。

DeepGEMM在共享内存中为A和B各分配了两个缓冲区，这就是经典的双缓冲模式。计算线程正在用缓冲区0的数据做矩阵乘时，加载线程已经同步把下一批数据搬进缓冲区1。等这一轮计算结束，互换角色，缓冲区1的数据开始参与计算，缓冲区0继续加载后续数据。这样做的好处是，数据加载的延迟被计算过程完全遮盖，内核的主循环变成了流水线式的“加载-计算-加载-计算”。

寄存器级缓存同样重要。每个线程计算8×8的输出微块时，需要把A的某个子向量和B的某个子向量留在寄存器里反复使用，避免每次都去共享内存里取。寄存器访问速度虽然比共享内存快，但毕竟是有限的资源，分配不当就会出现寄存器溢出，数据被挤到本地内存，性能悬崖式下跌。

3.3 Tensor Core 调用与布局转换

要触发tensor core，最关键的是数据布局。以常见的16×16×16矩阵乘指令为例，A矩阵的一个16×16分块需要以特定ldmatrix模式加载到线程束寄存器中。如果原始数据的内存布局不符合要求，要么做一次共享内存内的转置，要么在全局内存加载时通过向量化读取配合共享内存swizzle操作完成布局重排。

这里我踩过一个经典的坑：直接把原始的row-major数据塞进tensor core，结果指令根本没触发，性能还不如普通CUDA核心算得快。原因是布局不满足硬件要求，驱动会走fallback路径。正确做法是在共享内存中完成“读A转置、读B转置”的预处理，写回时再用向量化stmatrix指令一次性写出一整块结果。

布局转换听起来繁琐，但它换来的是每次tensor core调用能完成远超普通的计算量。用生活类比解释的话，普通CUDA核心相当于一个人一次拿一个箱子，tensor core相当于开了一辆卡车一次拉一集装箱，但前提是货物必须按特定方式码放整齐。布局转换就是码放货物的时间，花得值。

4. 实操：从零实现一个高效的 GEMM Kernel

这一节进入正题。我基于CUDA实现了一版可直接参考的GEMM内核骨架，代码结构清晰，注释对应上文的每一处设计决策。需要注意，这里的代码以逻辑演示为主，实际跑分还需要根据你的设备微调分块参数。

4.1 Kernel 骨架与线程映射

#define BM 128 #define BN 128 #define BK 32 #define TM 8 #define TN 8 #define THREADS 256 __global__ void deepgemm_kernel( const half* __restrict__ A, const half* __restrict__ B, float* __restrict__ C, int M, int N, int K) { // 当前线程块负责的输出宏块起始位置 int blockRow = blockIdx.y * BM; int blockCol = blockIdx.x * BN; // 共享内存缓冲区：A分块和B分块各两个（双缓冲） __shared__ half As[2][BM][BK]; __shared__ half Bs[2][BK][BN]; // 线程编号 int tid = threadIdx.x; // 累加器：每个线程负责 TM*TN 个输出元素 float acc[TM][TN] = {0.f}; // 共享内存加载索引：线程协作拷贝到共享内存 int loadRow = tid / (BK / 2); int loadCol = tid % (BK / 2) * 2; ... }

注意上面这段代码省略了加载细节和主循环。线程映射的思路是：256个线程协同把A的128×32分块和B的32×128分块搬进共享内存，每个线程负责搬多个元素，通过向量化读取提升带宽利用率。

主循环的核心逻辑是：从全局内存加载A和B的下一批数据到双缓冲区的下一侧，在上一侧的数据上执行tensor core计算。这个“计算当前、加载后续”的重叠就是上一节说的流水线。

4.2 双缓冲与异步 copy

CUDA提供了异步拷贝指令，可以在不经过寄存器的情况下把全局内存数据直接搬到共享内存。我在代码里用这个指令实现了真正的异步加载，让数据搬运不再占据线程的计算时间。

伪代码逻辑大致如下：

for (int k = 0; k < K; k += BK) { // 异步加载下一块 A 和 B 到缓冲区 buffer_idx^1 cp_async(As[buffer_idx ^ 1], A + global_offset_a); cp_async(Bs[buffer_idx ^ 1], B + global_offset_b); cp_async_commit(); // 提交异步拷贝组 // 等待当前缓冲区数据就绪 cp_async_wait_group(1); // 使用缓冲区 buffer_idx 执行 tensor core 计算 compute_tile(As[buffer_idx], Bs[buffer_idx], acc); __syncthreads(); buffer_idx ^= 1; // 切换缓冲区角色 }

这里有个细节：cp_async_wait_group(1)表示等待还剩1组异步拷贝未完成时继续。因为这一轮计算用的是buffer_idx，而下一轮数据正在加载到buffer_idx^1，所以只需要确保提交的异步操作不超过1组未完成，就能实现安全的重叠。

4.3 调优参数速查

不同硬件的tensor core规格、共享内存大小、寄存器数量都有差异，参数不能照抄。我整理了一份速查表，给出了常见情况的参数范围和使用建议：

选择参数时不要一次性全改，一次只调一个变量，观察性能曲线的变化方向。我试过同时调BM和BK，结果性能诡异下跌，后来拆开分析才发现是共享内存溢出触发了局部内存回退，单个参数怎么看都有问题。

5. 实测效果：从 profiling 到提速

理论设计再漂亮，最后还是得用数据说话。这一节记录DeepGEMM的实测结果和评估方法，方便你复现时对照。

5.1 测试环境与方法

测试环境为某型号数据中心级GPU搭配CUDA工具链，输入尺寸覆盖了三种典型场景：小矩阵（128×128）、中等矩阵（512×512）、大矩阵（2048×2048），K维度固定为1024。精度配置为FP16输入、FP32累加。

测试方法上我特别注意两点：一是多次运行取中位数而不是平均值，避免偶发频率波动和调度噪声干扰；二是每次测量前做预热，确保GPU进入稳定工作状态。数据全程使用同一批随机输入，保证可比性。

5.2 数据比对

直接看结果。以2048×2048×2048的大矩阵为例，基线版本（朴素实现，每个线程直接读写全局内存）测得的算力利用率只有约12%。加入共享内存分块后提升到35%左右。加入双缓冲流水线后进一步提升到55%。最后启用tensor core并完成布局转换，利用率跳到了80%以上。

从12%到80%，七倍左右的差距，靠的不是某一项黑魔法，而是四层优化逐级叠加的结果。每一层优化的收益都不一样，分块带来的收益最大，流水线和tensor core各贡献了可观的增量。

小矩阵场景的情况更有意思。128×128的矩阵规模较小，固定开销比如kernel启动、线程初始化、同步操作占总时间的比例更高。朴素实现和优化实现之间的差距反而缩小了，因为硬件本身就能在这么小的规模上快速完成计算。这提醒我一个重要结论：优化不是无脑套模板，要先看规模再定策略。

6. 踩坑与排查：共享内存不够、数值漂移、性能上不去

写kernel的过程中，我几乎把常见性能陷阱踩了个遍。每次踩坑后都花了不少时间排查，回头整理出来，至少能帮你省下几周弯路。

6.1 共享内存与寄存器超限问题

共享内存超限是最容易遇到的问题。BM、BN、BK越大，分块数据占用的共享内存越多。某次我把BK从32改成64，直接导致编译失败或运行时出现隐式回退。关键是理解共享内存有两层限制：线程块内声明数组不能超过单块共享内存上限，同时要留出足够的空间给tensor core操作数重排。

寄存器超限的表现稍有不同。寄存器分配过多时，编译器会把多余变量排挤到本地内存，kernel日志那叫一个难看，带宽占用直接飙升到好几倍，性能却掉到脚踝。我在调TM×TN时遇到过这个坑，改成小尺寸后性能不降反升，就是因为寄存器压力降下来了。

6.2 数值稳定性问题

用了FP16之后，某些形状的矩阵乘结果会出现肉眼可见的精度下降，尤其是K维度特别大的时候。FP16的尾数位数只有11位，中间累加结果如果直接用FP16存，误差会快速累积。我的解决方案是强制FP32累加，即tensor core输入用FP16，但累加器全程保持FP32，只在最后写回输出时转成需要的格式。

还有一个细节容易被忽略：当K维度很大时,中间累加值可能远大于单个乘法的结果，这时即使累加器是FP32，逐项加法的浮点误差仍然存在。更激进的做法是用分裂累加，把累加结果拆成高位和低位两个FP32变量，或者使用Kahan补偿算法。不过对于绝大多数深度学习场景，FP32累加已经够了，分裂累加属于锦上添花。

6.3 性能瓶颈难定位时的排查思路

如果性能低于预期，我的建议是按照固定顺序排查：首先看kernel是否实际启用了tensor core指令，方法是在编译选项中打开ptx/dump输出，检查指令序列；其次看共享内存和寄存器占用是否正常；再次是分析数据加载阶段是否存在bank conflict。

bank conflict是共享内存里的隐形杀手。当多个线程同时访问同一bank的地址时，硬件会把访问串行化，导致共享内存带宽骤降。在加载A和B分块时，我调整了线程索引和内存地址的映射关系。用一个简单的swizzle操作把需要同时访问的地址散布到不同bank。这个改动带来的性能提升比预期大得多，尤其在BM和BN比较大的配置下。

还有一个常见的诊断技巧：单独注释掉tensor core计算，只保留数据加载逻辑。如果加载阶段本身的耗时已经占比很高，说明问题出在访存路径；如果加载很快但整体很慢，则问题多半在计算指令或同步开销上。

7. 一些收尾经验

整个DeepGEMM做下来，我最大的体会是，高性能计算优化与其说是炫技，不如说是一遍遍和硬件对话。每次性能卡住，都是因为我某个假设没考虑硬件的真实行为。比如以为共享内存越大越好，结果忽略了bank conflict；以为tensor core必定加速，结果忽略了数据布局要求。

最后再分享一个小技巧：调参时不要只看最终的GFLOPS数，要同时记录共享内存占用、寄存器数、kernel耗时三个指标。三者之间的关系往往比单一指标更能说明问题。我手上常备一张纸，每调一次参数就更新一列数据，哪个参数改变引起哪些连锁反应，一眼就能看出规律。

如果你也想自己写一个GEMM内核，建议从最简单的版本开始，把基线跑通，再一层层叠加优化。每加一层优化，都对比一次基线，确认收益真实存在再继续。不要一口气把所有技巧全塞进去，否则出了问题根本分不清是哪个改动导致的。DeepGEMM这个项目虽然规模不大，但从原理分析到落地调优的完整链路，比单纯调用厂商库获得的那点性能提升更有价值。