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简介：博光D110 940nm VCSEL激光器数据手册，面向从事ToF三维感知、扫描LiDAR与红外照明等领域的硬件工程师及光学设计人员。文档完整呈现该3结VCSEL阵列的性能指标，包括短脉冲条件下70W输出功率、2.7W/A斜率效率、5ns脉宽、0.2MHz重复率，以及934～946nm波长范围和21°光束发散角等电光特性；同时给出芯片尺寸、焊盘尺寸、Au接触方式等机械特性与封装细节，可直接用于选型评估、驱动电路设计与光学系统仿真。资源为单个PDF文件，整包仅754KB，便于下载后快速查阅。数据手册发布于2021年，目前已有304人学习参考，适合需要准确获取940nm VCSEL关键参数、进行方案比对的工程师使用。

1. 940nm VCSEL：3D感知里最难选的那颗光源

做结构光或者ToF的硬件工程师，大概率都在同一页Excel里被困住过：模板里的光源选项写着EEL、LED和VCSEL，下面一栏是波长，再往右是功率。你会发现在940nm这个波段，VCSEL几乎成了默认答案。EEL的椭圆光斑和像散在消费级模组里很难纠正，LED的光束参数又不够理想，而940nm VCSEL在环境光抑制、人眼安全余量和系统成本上恰好落在一个舒服的平衡点。博光D110就是这一定位上的一款代表性产品，940nm波长、VCSEL结构，面向ToF测距、激光雷达补光以及工业接近探测。这篇文章不打算复述规格书，而是回到几个更底层的选择逻辑：为什么是940nm，D110这类芯片的驱动和测试有哪些绕不开的细节，以及当你拿着它去做整机时，真正会踩的坑在哪儿。

2. 从结构到波长：VCSEL凭什么在940nm站住脚

2.1 垂直腔的“小”优势：DBR、量子阱与氧化层如何共同决定D110的发光质量

VCSEL的“V”在于它的谐振方向。光在有源区里沿垂直于芯片表面的方向来回反射，上下各有一叠分布式布拉格反射镜（DBR），这叠反射镜由高折射率与低折射率材料交替生长而成，反射率通常做到99.5%以上。只有这么高的反射率，光才能在只有几个微米厚的增益区里完成足够多次往返并增益放大。这种“短腔长、高反射镜”的组合，带来了两个直接好处：一是纵模间距大，激光器更容易在单纵模或少数几个纵模下工作，光谱宽度通常只有0.5到2nm；二是发光面在芯片表面，天然适合二维阵列集成。

940nm的量子阱材料体系基本是InGaAs/AlGaAs。量子阱的厚度和组份决定增益峰值对应的波长，这在量产时由外延工艺严格锁定。氧化层结构的设计也很关键：VCSEL通过湿法氧化把电流孔径从几十微米的外延台面收缩到几个微米，同时利用氧化层与未氧化区域的折射率差形成横向折射率导引。博光D110如果属于阵列式产品，每个发射极的氧化孔径必须非常均匀，因为孔径不平直接表现为阈值电流分散、远场出现热点，阵列里某个点先衰减的情况也多半从这里开始。

2.2 850nm与940nm的取舍：环境光、探测器响应与眼安全的三方权衡

波长选择从来不是只看增益材料能不能做出来，而是要同时照顾传感器、背景辐射和应用安全。这三个维度放在一起看，850nm和940nm的差异就很有意思了。以下是一张我常用来跟团队成员对齐的对比表：

这颗芯片如果放在ToF模组里，你真正关注的其实是“在同样的平均光功率下，信噪比能不能够到目标距离”。室外强光环境下，太阳在850nm附近的辐射通量明显高于940nm，所以后者的背景光噪声更小。即使硅传感器在940nm的量子效率下降了一些，整体端到端的信噪比仍然可能更优。而人眼安全方面，虽然940nm仍落在视网膜危害波段之内，但接近红外末端的灵敏度已极低，IEC 60825-1给出的可达发射限值会比850nm宽松，这对动辄几瓦峰值功率的脉冲ToF方案是极大的让步空间。

2.3 从单孔到阵列：D110这类芯片为什么能打高功率

单个VCSEL发射极的功率通常在毫瓦量级，氧化孔径做得再大也会碰到高阶横模和热饱和问题。要在1瓦甚至更高峰值功率下工作，通用办法是把几十甚至几百个发射极排列成二维阵列，让它们通过同一个键合焊盘并联发光。阵列的间距设计要考虑两点：一是热串扰，相邻发射极如果贴得太近，结温升高会让阈值电流整体抬升；二是远场均匀性，点阵间距和发光孔径共同决定你在目标平面看到的是近似平顶的光斑，还是带周期性条纹的衍射图样。

这也解释了为什么同样是940nm VCSEL，不同型号的芯片在驱动上会有差异。D110如果规格书里写的是“多结堆叠”（multi-junction）结构，那意味着在每个发射极里纵向堆了多个量子阱有源区，这可以让相同电流下获得更高的光功率和斜率效率，代价是正向电压成倍增加，从常规单结的1.8V左右堆到3.5V甚至更高。驱动电路的设计必须把这个电压余量算进去，否则输出端到VCSEL阳极的压降会不够，脉冲顶部会提前“削顶”。

3. D110参数落地：从规格书到驱动电路与脉冲调试

3.1 先看懂规格书上的这组参数

拿到任何一款940nm VCSEL的规格书，我通常不会先看功率，而是按下面这个顺序扫参数：

其中发散角是新手最容易忽视的。940nm VCSEL的远场虽然近似圆形对称，但它的光束质量因子M²通常在2到10之间，不是理想单模高斯光。你按高斯光束公式去计算准直镜焦距，得到的光斑尺寸会偏小，实际投射出来会比预期宽。更好的做法是直接用光束质量分析仪测D110的实际远场分布，再回推光学系统参数。

3.2 三种驱动拓扑，对应不同ToF架构

连续驱动（CW）最简单，用恒流源把电流稳定在阈值之上即可，适合热量可以任意排放的工业接近开关。但CW模式下VCSEL结温长时间维持在工作点，输出功率会随时间滚降，所以消费级ToF几乎不这么用。更常见的是准连续脉冲驱动（quasi-CW），以1%到5%的占空比施加纳秒到微秒级电流脉冲，让芯片在短时间达到数倍的额定额定电流，同时平均功耗可接受。

第三种是阵列分区驱动。D110如果内部有独立可寻址的发射极分组，就可以在不同时间内点亮不同区域，实现泛光、点阵投射或者相位编码。这种驱动对PCB布线有额外要求，阳极公用层和分组阴极层之间的寄生电感要控制到纳亨级，否则快速开关时地弹噪声会窜到模拟前端。

3.3 用Python算一次脉冲驱动参数

初次调驱动，我习惯先把RC放电模型跑一遍，不用上来就上GaN驱动芯片。下面的代码演示如何估算峰值电流和脉宽衰减：

# 计算 VCSEL 脉冲驱动中 RC 放电的峰值电流与脉宽 # 目标工作点：峰值电流约 1A，脉宽约 50ns C_discharge = 1e-9 # 放电电容 1nF R_loop = 3.0 # 回路总电阻（含VCSEL动态电阻、开关导通电阻、走线电阻） V_supply = 5.0 # 驱动母线电压 V_f = 1.8 # VCSEL 在 1A 附近的正向压降（参考规格书） V_switch = 0.3 # GaN FET 导通压降（典型值） V_effective = V_supply - V_f - V_switch I_peak = V_effective / R_loop # 欧姆定律估算峰值电流 tau = R_loop * C_discharge # RC 时间常数 t_half = tau * 3.14 * 0.693 # 半功率点近似为 0.693*tau，3.14 为圆周率修正 print(f"峰值电流: {I_peak*1000:.0f} mA") print(f"RC时间常数: {tau*1e9:.2f} ns") print(f"半功率脉宽(估算): {t_half*1e9:.1f} ns")

这段代码的逻辑是：开关闭合瞬间，电容两端电压等于母线电压减去VCSEL正向压降和开关管压降，再除以回路总电阻得到峰值电流；随后电容放电，电流按指数衰减。为什么只用一阶RC而不用更复杂的模型？因为在早期验证阶段你手上往往没有准确的寄生参数，RC模型足够判断“电源电压该提多高、电容该多大”。如果你发现实际波形上升沿拖尾严重，那问题多半在回路电感，而不是RC模型本身。

代码里的3.14是个经验修正项，用来把指数衰减折算成等效矩形脉冲宽度。更严谨的做法是直接用示波器抓电流波形，但做方案选型时这个估算已经够了。实际调板时，V_f要随着结温升高而略有下降，R_loop则要包含电解电容的ESR和PCB走线电阻，不要直接用万用表的欧姆档去量，那测的是直流值而不是高频动态值。

3.4 驱动板首次上电的调试顺序

拿到一块D110驱动板，我一般按以下路径排查，顺序基本固定：先不给VCSEL供电，单独用示波器验证驱动管栅极波形。确认栅极驱动电压和死区时间没问题后，把VCSEL替换成同阻值的功率电阻，看电流波形是否达到目标脉宽。这一步能帮你区分是驱动电路问题还是激光器问题。然后才是装上VCSEL，但首次点亮时把电流降到目标值的四分之一，观察是否有弱光输出。

点亮之后要做的是快速扫一遍脉宽与峰值电流矩阵，分别测量光功率。记录下阈值电流的位置——如果阈值电流和规格书偏差超过30%，优先怀疑焊接温度过高导致VCSEL内部应力变化，或者氧化区域进水。另外，第一次上电前绝对要用万用表确认VCSEL的极性，多结阵列一旦反接，反向击穿电压通常不超过5V，一颗几百块钱的芯片就会直接报废。

4. 光学测试与热可靠性：940nm VCSEL最容易翻车的两个地方

4.1 四种必备测量：功率、光谱、近场、远场

任何VCSEL测试都逃不开这四样。总光功率用积分球加功率计测，必须把探头的响应波长设置到940nm。光谱用光谱仪或光谱分析仪看峰值波长和半高宽，重点确认峰值波长随脉冲电流的偏移是否过大。近场用显微镜物镜加CCD直接看发光面的光点分布，能发现单个发射极不亮或发光强度不均的问题。远场则需要把探测器或光束分析仪放在距离芯片10到20厘米处，测出实际发散角，这个数据对光学设计最有用。

下面这张表列出了我常用测试设备背后的考量：

4.2 搭一个自动功率测试台：PyVISA驱动功率计

做可靠性试验或产测时，手动记录数据不现实。下面是一段用PyVISA控制Thorlabs PM100D功率计和温度计的示例脚本，单位以毫瓦输出：

# 自动读取 940nm VCSEL 的光功率与环境温度 # 依赖：pip install pyvisa pyvisa-py import pyvisa import time rm = pyvisa.ResourceManager() # 打开功率计（不同USB设备地址不同，用rm.list_resources()列出） pm = rm.open_resource('USB0::0x1313::0x8075::P0012345::INSTR') pm.timeout = 2000 # 关键：把探头响应波长设置到940nm，否则读数不是真实光功率 pm.write('CORR:WAV 940') # 打开数字温度计（GPIB示例地址） tc = rm.open_resource('GPIB0::10::INSTR') for i in range(5): try: temp = float(tc.query('MEAS:TEMP?')) power_w = float(pm.query('MEAS:POW?')) print(f"轮次{i+1} 温度={temp:.1f}C 光功率={power_w*1000:.2f}mW") except pyvisa.VisaIOError as e: print(f"读取失败: {e}") time.sleep(1) pm.close() tc.close()

这里有三个细节值得展开。第一，CORR:WAV 940这行命令很关键，因为InGaAs光电二极管探头的响应度随波长变化，仪表必须按真实波长修正增益。实测下来，用850nm的校准数据测940nm光，读数会偏低约15%到20%。第二，timeout参数要设置足够大，因为某些功率计在自动量程切换时会卡顿几百毫秒。第三，读数循环里加入异常捕获很有必要——可靠性老化的过程中偶尔会有单次读取超时，不能因为一次超时中断整个老化曲线记录。

4.3 热管理：0.06nm/K的波长漂移加起来有多严重

940nm VCSEL的波长温度系数大致在0.05到0.08nm/K附近，取0.06nm/K算一笔账：结温从25°C升到85°C，峰值波长漂移3.6nm。如果接收端用的是940±5nm窄带滤光片，此时的透过率边缘已接近损失一半，等效于测距灵敏度下降。更麻烦的是，阈值电流随温度按指数关系上升，Ith(T) = Ith(25°C) * exp((T-25)/T0)，其中T0在940nm VCSEL上典型为120到170K。结温升高后，相同驱动电流下输出功率会明显下降。

解决路径只有一条：把热阻做低。芯片到PCB的导热路径上，避免用普通FR4直接贴装，尽量用铝基板或热电分离焊盘；底部过孔要加满并尽量靠近芯片中心。如果你做的是11W级阵列，热电分离设计带来的效率差别可能超过15%，同时故障率的差别更大。我在实验室做老化时有个固定动作：用热像仪对准VCSEL阳极焊盘侧拍一张温度分布，如果热点偏移到键合线侧，说明焊层有空洞。

4.4 可靠性：高温、高湿与静电

940nm VCSEL的失效模式中，氧化层退化是比较典型的。湿气沿键合线或芯片边缘渗入后，会加速氧化层界面态增长，导致阈值电流缓慢上升。所以这类器件通常对存储湿度敏感，拆封后如果在湿度60%RH以上的环境暴露超过8小时，上线前建议进行125°C烘烤。静电方面，虽然VCSEL不像LED那样脆，但多结阵列正反向都怕ESD，操作时手腕带和离子风机别省。

5. 系统集成里的三个实用技巧

5.1 配合ToF传感器时，先查SPAD的峰值响应波长

多数ToF传感器里的SPAD（单光子雪崩二极管）峰值响应在750到850nm之间，到了940nm量子效率往往只剩下峰值的60%到70%。直接沿用850nm系统的功率预算，会让你的距离指标达不到。正确做法是先拿到传感器的量子效率-波长曲线，在940nm处读出实际响应度，再反向推算所需光功率。许多方案会为此加大VCSEL驱动电流，但这会推高结温并进一步拉低功率，所以更健康的思路是优化光学链路透过率，比如用窄带滤光片压低背景光，而不是用更大的电流怼上去。

5.2 人眼安全Class 1的快速上限估算

虽然最终安规认证必须送测，但方案阶段需要对上限有个数。IEC 60825-1对脉冲激光的允许发射限值计算涉及脉冲宽度、重复频率、波长和光斑大小多个修正因子，940nm因为人眼灵敏度低，限值会明显放宽。快速估算时，可以先按平均功率安全等级来观察：假设你的脉冲峰值功率10W、脉宽50ns、重复频率100kHz，占空比0.5%，平均功率50mW，远高于Class 1的连续波限值，但因为脉冲宽度极短，可达发射限值可以按峰值再乘一组修正因子（约几倍到几十倍）。这个计算很绕，我用过一个更实用的办法：找到一颗已经通过Class 1认证的竞品ToF模组，反推它的峰值功率和参数组合，作为自家系统的初始设计目标。这样做既省时间也留出余量。

5.3 从850nm迁移到940nm，至少要改这三处

第一，衍射光学元件（DOE）不能共用。DOE的微结构相位延迟是波长相关的，850nm设计的DOE用在940nm上，衍射效率下降且投射图案会出现颜色分离。第二，接收端带通滤光片要换中心波长，同时要关注带宽是否匹配D110的温漂范围。若滤光片FWHM只有5nm，夏天高温时D110波长飘到945nm，透过率可能已经衰减到50%以下。第三，驱动电路的过冲和阻尼会略有变化，因为940nm VCSEL的动态电阻与850nm版本不完全相同，沿用旧电路的RC值最好重新算一遍，别只改软件里的电流设定表。

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