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xv6如何支持多核？SMP启动、LAPIC与IOAPIC中断路由深度剖析

【免费下载链接】xv6-publicxv6 OS项目地址: https://gitcode.com/gh_mirrors/xv/xv6-public

xv6 是 MIT 6.828 操作系统课程的教学内核，它完整实现了 x86 SMP（对称多处理）支持：从引导处理器（BSP）通过 MP 表探测其他 CPU，到用 LAPIC 启动非引导核（AP），再到 IOAPIC 把硬件中断路由到不同 CPU。本文带你快速理解 xv6 多核启动流程与中断路由机制。

一、xv6 多核架构全景

xv6 假设硬件具备 SMP 能力，最多支持8 个 CPU（定义于 param.h 的NCPU），最多64 个进程（NPROC）。

它的多核设计可以用四个角色概括：

其中 proc.h 中的struct cpu是每个核的"档案袋"：记录apicid（核编号）、scheduler（调度器上下文）、started（是否已启动）、当前运行的proc指针等。所有核共享一张进程表，各自独立跑调度器——这就是"对称"的含义。

二、如何发现机器上有哪些 CPU？

内核启动入口在 main.c 的main()，它的初始化顺序非常讲究：

kinit1 → kvmalloc → mpinit → lapicinit → seginit → picinit → ioapicinit → ... → startothers → userinit → mpmain

第一步是mpinit()，定义在 mp.c。它做了三件事：

1. 寻找 MP 浮动指针结构：按规范依次在 EBDA 区、系统基内存末尾 1KB、BIOS ROM（0xF0000–0xFFFFF）三处搜索_MP_签名（见 mp.c 的mpsearch()），并校验和。
2. 验证 PCMP 配置表：检查PCMP签名、版本号与校验和。如果找不到，直接panic("Expect to run on an SMP")——xv6 只跑在 SMP 硬件上。
3. 解析资源条目：遍历配置表，把每个 CPU 的apicid存入cpus[]数组，记录 IOAPIC 的apicid（ioapicid）和 LAPIC 的映射地址。

💡 值得注意：APIC ID 不一定等于逻辑 CPU 编号，所以 xv6 专门维护cpus[i].apicid字段。

三、LAPIC 初始化与定时器中断

main()接着调用lapicinit()（lapic.c），它完成 LAPIC 的关键配置：

• 使能本地 APIC，设置伪中断向量；
• 配置周期定时器：LAPIC 内置定时器以总线频率倒数计数，计满后周期性触发时钟中断（IRQ_TIMER）。这是 xv6 的"心跳"，驱动了时钟计时与进程抢占；
• 屏蔽无用中断线（LINT0/LINT1、性能计数器），把错误中断映射到IRQ_ERROR；
• 广播一次 INIT 信号，同步各核的仲裁 ID。

每个核（包括后来启动的 AP）都会执行一遍这套初始化。

四、SMP 启动的核心：如何唤醒沉睡的 AP？

多核系统里，BIOS 只启动第一个核（BSP），其余核处于复位挂起状态。xv6 通过startothers()（main.c）+ LAPIC 的"通用启动算法"唤醒它们：

1️⃣ 放置 AP 入口代码

startothers()把 entryother.S 编译出的入口代码拷贝到物理地址0x7000（低内存，所有核都能访问），并在代码前面留出 3 个指针位：

• start-4：为该核新分配的内核栈（kalloc()分配）
• start-8：跳转目标mpenter()
• start-12：引导页表entrypgdir的物理地址

之所以用简单的entrypgdir（4MB 恒等映射）而非完整内核页表，是因为 AP 启动时还在低内存中运行，用 4MB 大页的恒等映射最简单可靠。

2️⃣ 发送 IPI 唤醒（LAPIC 的看家本领）

真正的唤醒动作在lapicstartap()（lapic.c），严格遵循 Intel 多处理器规范的"通用启动算法"：

① 写 CMOS 关机码 0x0A + 设置 warm reset 向量指向 0x7000 ② 发送 INIT IPI（电平触发）→ 复位目标 AP ③ 等待 200us 后撤去 INIT ④ 连发两次 STARTUP IPI，携带入口地址高 12 位

STARTUP 让 AP 从XY00:0000（XY 即地址高 8 位）开始执行。第二个 STARTUP 在真实硬件上会被忽略，但它是官方算法要求的动作。

3️⃣ AP 的自举之路

AP 醒来后运行 entryother.S，走一遍"迷你引导流程"：

1. 关中断、清零数据段寄存器
2. 加载临时 GDT，置 CR0.PE，从实模式切换到保护模式
3. 打开 CR4.PSE（4MB 大页），把entrypgdir装入 CR3，打开分页
4. 切换到 BSP 分好的内核栈，调用mpenter()
5. mpenter()（main.c）中：切换到完整内核页表switchkvm()→ 初始化段 →lapicinit()→ 进入公共流程mpmain()

4️⃣ 握手同步与进入调度

mpmain()（main.c）是每个核的最后一步：

idtinit() // 加载中断描述符表 xchg(&mycpu()->started, 1) // 打"我启动了"旗标 scheduler() // 从此进入死循环调度

BSP 那边在startothers()里正阻塞在while(c->started == 0);（main.c），看到这个旗标后继续唤醒下一个核。这种"旗标握手"是极简而有效的核间同步。

之后每个核运行自己的scheduler()（proc.c）：打开中断 → 锁住进程表 → 找到RUNNABLE进程 →swtch()切过去。N 个核就是 N 条独立的调度流水线，可以真正并行运行 N 个进程。

五、IOAPIC 中断路由：谁处理磁盘中断？

单核时代中断由 8259A PIC 管理，但 PIC 无法把中断送到指定核。SMP 系统改用IOAPIC（默认映射在物理地址0xFEC00000，见 ioapic.c）。

重定向表：中断的"分派台"

IOAPIC 的核心是重定向表：每个 IRQ 占两个寄存器——低寄存器控制使能/触发方式/中断向量，高寄存器的高 8 位是目标 CPU 的 APIC ID（ioapic.c 的注释讲得很清楚）。

• ioapicinit()（ioapic.c）先验证 IOAPIC ID 与 MP 表一致，然后把所有 IRQ全部禁用并取消路由——干净起点。
• ioapicenable(irq, cpunum)（ioapic.c）再把指定 IRQ 重新使能并指向指定核。

xv6 的路由策略很有讲究（结合 param.h 的 NCPU=8）：

把磁盘中断路由到最后一号核是个巧妙设计：磁盘 IO 是典型热点，把它集中到一个核上，避免多个核频繁竞争磁盘相关的锁，也让 0 号核专注于调度与控制台。

中断分发后的处理

所有中断最终汇入 trap.c 的trap()统一分发：

• 时钟中断：每个核都会收到（LAPIC 定时器是"核内"中断），但只有 CPU 0在tickslock保护下递增全局ticks并唤醒 sleep 等待者（trap.c）——防止多核重复计数。
• 磁盘/键盘/串口中断：调用各自处理函数后，一律lapiceoi()向 LAPIC 发 EOI（End of Interrupt）确认，否则 LAPIC 会认为中断还没处理完而不再投递。

📌 对比一下：picirq.c 里的picinit()直接屏蔽了传统 8259A 的全部中断，注释直言"xv6 假设 SMP 硬件"。IOAPIC 完全取代了 PIC。

六、小结：xv6 多核设计的三个要点

✅规范驱动的启动：MP 表探测 + Intel 通用启动算法（INIT → STARTUP×2），代码注释里几乎逐条对应规范原文，是学习 x86 SMP 规范的最佳活教材。

✅核间同步极简：只靠started旗标握手、每核独立调度器、共享进程表 + 自旋锁，没有引入复杂的核间消息机制——教学内核的克制正是它清晰的原因。

✅中断分级路由：LAPIC 管核内中断（时钟人人有），IOAPIC 管外设中断（键盘归 0 号核、磁盘归末号核），tick计数则用锁保证全局一致——小而完整的 SMP 中断世界。

想动手验证，可以阅读 Makefile 中的 QEMU 目标启动 xv6，在控制台看到cpu0: starting 0、cpu1: starting 1等每核启动日志，再结合本文的 main.c 启动序列对照，xv6 的多核之旅就完整走通了。

【免费下载链接】xv6-publicxv6 OS项目地址: https://gitcode.com/gh_mirrors/xv/xv6-public