做电源设计这几年,60V降压转5V、3.3V、12V这种方案我接触得不算少,但真正让我把热设计当成头等大事的,是去年一块48V电池组供电的辅助电源板。输入直接从电池包取电,最高能到60V,三路输出分别给MCU、传感器和驱动电路供电,电流不大但分布很散。样机一上电,电感先烫手,MOS管一路飙到90℃,整块板子像个小暖炉。后来我把工作频率降下来、换成同步整流、重新做电感选型和散热铜皮,温度才算压住。这篇文章就把这个项目里踩过的坑、验证过的办法摊开聊一聊,重点放在电感选型、MOS管损耗和散热布局这三块。
1. 60V降压到5V、3.3V、12V:方案选型先想清楚热量从哪来
1.1 应用场景与需求拆解:别只看到“三路输出”
很多新手拿到“60V降压转5V、3.3V、12V”这个需求,第一反应是找一颗多路输出电源芯片,把三路电压直接拉出来,然后画个板子就完事。实际项目里这么干基本要返工,因为你需要先搞清楚输入是什么、负载是什么、环境温度是多少、长期可靠性要求多高。
我做的这个项目是48V电池组供电的辅助电源,电池充满电接近58V,加上充电回馈和瞬态过冲,实际输入最高会摸到60V以上,所以输入耐压我按65V~70V去选型。三路输出分别是5V/3A、3.3V/2A、12V/1.5A,5V给主控MCU和显示屏,3.3V给传感器和逻辑电路,12V给风扇、继电器和运放供电。看起来都不是大电流,但三路加起来总功率接近30W,在60V输入高压差条件下,哪怕是90%效率,整板也有接近3W的热量要散掉。
需求拆解阶段就要把热指标定下来:芯片结温不超过125℃,MOS管壳温不超过100℃,电感表面温度不超过95℃,环境温度按最高55℃设计。这些指标直接决定了后面所有的选型、频率和布局策略。如果等到板子做好了再测,发现温度超了再改,周期和成本都会翻倍。
1.2 为什么说热设计在高压差降压里比“能不能转”更重要
60V输入和5V输出之间压差有55V,Buck电路理想占空比只有8%左右。这个数字背后藏着一个容易被忽视的细节:高边开关管导通时间极短,但低边续流器件导通时间极长,占空比越小,续流路径上的损耗占比越大。
用具体数字感受一下。5V/3A输出,如果低边用一颗普通肖特基二极管续流,正向压降按0.5V算,续流时间占约92%,那么二极管的损耗大约是0.5V乘以3A再乘以0.92,算出来1.38W。这还只是一路,12V那路如果也用二极管续流,损耗又是好几瓦。整板热量会非常集中,电感也会因为周围高温而加速老化。
所以60V降压这种高压差场景,热设计的第一条铁律就是:能同步整流就同步整流,让低边MOS管的导通压降远小于二极管。同样输出条件下,低边MOS导通电阻按15mΩ算,损耗大概是3A平方乘以0.015Ω再乘以0.92,只有0.12W左右,比二极管续流少了整整一个数量级。这也是为什么这类项目里,热设计不是“最后加个散热片”的事,而是从拓扑选型那一刻就要开始考虑。
1.3 降压拓扑与芯片选型:同步Buck多路输出怎么做
多路低压输出大体上有两种路线:一种是用反激电源,先通过变压器隔离出多路,再分别做线性稳压;另一种是用多路独立的同步Buck芯片,每一路直接从60V降到对应电压。反激的优势是隔离、一路搞定,但交叉调整率差,热设计也很头疼,变压器是天然的集中热源。同步Buck多路方案体积大一点,但每一路都可以独立调环路,效率高,热量分散,调试也直观。
我最后选了后者,5V用一颗集成上下管的高压同步Buck,3.3V和12V各用一颗同步降压控制器外搭MOS管。选型时重点看四个指标:输入耐压至少要75V以上,开关频率选300kHz到600kHz之间可以平衡电感体积和效率,上管和下管的导通电阻尽量低,封装热阻要清楚。还有一点容易被忽略,电源管理芯片的引脚定义一定要逐个对着datasheet确认,相同封装的芯片引脚顺序可能完全不同,我就见过有人把LY3206这类芯片的FB和COMP接反,导致输出直接过压保护,查了一整天。
另外建议先做一颗最小系统的验证板,只搭输入、芯片、电感和输出,用电子负载和示波器把开关节点波形、负载调整率都确认了,再画完整的多路PCB。60V高压上电调试时,输入串一个100Ω功率电阻限流,避免出现短路或饱和时炸管炸芯片,这是我在实验室里留下来的习惯。
1.4 效率目标怎么定:别被spec书上的最高效率骗了
电源芯片规格书上的效率曲线,通常是在某一组特定输入电压、输出电流下测出来的最优值,可能高达95%。但你的实际工作点很难落在那个甜点上,尤其是60V输入转5V这种占空比极小的工况,效率会比标称值低不少。
我做完第一版样机后实测,5V那一路满载效率只有84%左右,也就是输出15W时损耗超过2.8W。整个板子三路加起来,总损耗接近6W,在密闭机箱里根本扛不住。后来通过降低开关频率到400kHz、换用更低Qg的高压MOS、增大电感值降低纹波电流,才把总效率提到91%以上。效率每提升1个百分点,热设计压力就会下降很明显,所以选型阶段一定要把目标效率定出来,比如5V这路满载不低于90%,12V这路不低于92%,达不到就换方案,不要等到Layout完再后悔。
2. 电感:高压降压里最容易被低估的“加热器”
2.1 电感在低占空比降压电路里的电流波形
很多人选电感只看电感量和额定电流,忽略了这个电感在60V输入、5V输出电路里实际承受的电流纹波和磁通变化。Buck电路CCM模式下的电感纹波电流可以用一个很简单的公式估算:ΔI等于(Vin减Vout)乘以D,再除以开关频率和电感量。这里的D是占空比,约等于Vout除以Vin。
代入我的参数看看:Vin等于60V,Vout等于5V,D大约是0.083。如果开关频率选600kHz,电感量选10μH,那么ΔI约等于55V乘以0.083,再除以600kHz乘以10μH,算出来在0.76A左右。如果电感量降到4.7μH,ΔI会直接跳到1.6A以上,峰值电流就是输出电流加上一半纹波,3A输出时峰值可能接近3.8A。对于小体积电感,这个峰值电流已经逼近饱和边缘了。
高压差降压电路的纹波电流天然偏大,因为你加在电感两端的伏秒积没有变,但开关导通时间很短,电流变化率很陡。这种情况下,电感量的选择不能照搬低压差电路的“经验值”,需要专门计算,并且给饱和电流留出温度降额空间。
2.2 电感选型:电感量、饱和电流、DCR和磁芯损耗怎么权衡
电感量选大一点,纹波电流小,输出纹波电压也小,但DCR会变高,铜损增加,体积变大。电感量选小一点,体积小但纹波大,磁芯损耗和线圈交流损耗会增加,峰值电流对饱和的要求也更高。这里没有“绝对正确的值”,只有适合你工作点的平衡。
我当时的选型逻辑是这样:先根据纹波率r通常在0.2到0.4之间确定最小电感量,保证CCM模式稳定;再把最大负载电流加上一半纹波电流,再乘上1.3倍的高温饱和裕量,作为电感的饱和电流下限。以5V/3A为例,如果纹波电流设计成1A,峰值电流就是3.5A,那么饱和电流至少要按4.5A以上选,最好到5A,因为在高温下磁导率会下降,饱和电流标称值通常是在25℃条件下给出的。
DCR方面,损耗可以用P等于I_rms平方乘以DCR粗略估算,CCM模式下I_rms约等于输出电流,3A电流流过一颗DCR为30mΩ的电感,损耗就是9乘以0.03等于0.27W。这在单路输出里已经不小了,三路加起来会很可观。所以功率电感优先选DCR低的合金粉或铁硅铝磁芯,不要用那种绕线细、圈数多的工字电感,高温下铜损和磁芯损耗一起爆发,表面温度轻松超过100℃。
2.3 电感啸叫与电感发热的排查经验
电感啸叫这个现象非常有意思,电感本身不会无缘无故发声,通常是磁芯或线圈在交变磁场下产生机械振动,再通过PCB板放大到人耳可听范围。60V输入的低压降电路,最容易出现的啸叫原因有两个:一个是轻负载下芯片进入PFM或burst模式,开关频率降到20kHz以下的音频范围;另一个是环路补偿参数不合适,出现次谐波振荡,SW波形一顿一顿地抖。
排查的时候别急着换电感。先用示波器测SW节点波形,看频率是否落入音频段,看有没有重复性的低频包络;再用一个塑料棒顶着电感外壳,分别去碰电感本体和旁边的陶瓷电容,判断声音究竟是哪个元件发出的。遇到PFM模式啸叫,直接把芯片配置改成强制PWM模式,或者加一个假负载,让负载电流维持在CCM以上,问题基本就消失了。如果是环路不稳定,调整RC补偿参数,减小误差放大器带宽或者增加相位裕度,再重新测瞬态响应。
还有一种情况是电感磁芯在600kHz高频下磁致伸缩效应明显,发出的声音频率高于音频但会和低频频段混叠,这种一般通过换磁芯材料解决。我可以负责任地说,60V转5V这种大压差电路里,电感发热往往比我们想象的严重,磁芯损耗占大头,单纯换更低DCR的电感有时解决不了,你要看规格书里的磁芯损耗曲线和温升数据。
2.4 关于电感下面能不能铺铜、共模电感和LC滤波的提醒
电感下面能不能铺铜,这是一个经常在论坛里吵起来的问题。从散热角度看,电感底部铺铜确实能帮助导热,降低表面温度;但功率电感下面是高dv/dt的开关节点,铺铜会和电感线圈之间形成寄生电容,把高频骚扰耦合到铜皮上,进而通过地平面扩散,导致EMI变差。我的做法是:电感正下方尽量铺完整的地铜皮,不要有浮铜和信号走线,并且把这一块地和主功率地单点连接;如果电感工作在非常高的开关频率,例如1MHz以上,我会把电感正下方挖空,只保留局部散热过孔到内层地。
还有输入EMI滤波里的共模电感,选型时记住一个规律:共模电感容量越大,通常匝数越多,但磁芯容易饱和,额定通流反而越小。你不能只看感值,要同时查它的偏流饱和曲线,确认在最大输入电流下电感量不会掉得太厉害,否则EMI滤波性能大打折扣。输出LC滤波器的电感和电容取值也有讲究,转折频率至少要低于开关频率的十分之一,常见取开关频率的二十分之一左右,电容用低ESR的MLCC,同时注意LC谐振峰可能引起环路不稳,必要时加一个小阻尼电阻。
3. MOS管:60V输入的损耗主角,选型和驱动都得抠细节
3.1 MOS管在Buck电路里的损耗拆解
MOS管的热损耗不是单纯“导通电阻乘以电流平方”那么简单,在60V输入这种场景下,开关损耗甚至比导通损耗更致命。先看高边MOS,导通损耗等于I_rms平方乘以Rdson再乘以占空比,因为占空比很小,这部分损耗其实不高;真正的大头是开关损耗,公式是0.5乘以输入电压乘以输出电流乘以开关时间再乘以开关频率。
拿我的5V/3A那一路举例,高边MOS用100V耐压、Rdson为50mΩ的管子,导通损耗只有0.037W左右。但如果开关频率600kHz,开关时间tr加tf总共20ns,开关损耗就是0.5乘以60V乘以3A乘以20ns乘以600kHz,轻松超过1W。这就是为什么高压差降压电路里,高边MOS选型要重视Qg、Coss和开关速度,而不是只看Rdson。
低边MOS刚好相反,因为续流时间长,导通损耗占主导。同样3A负载,低边MOS Rdson做到10mΩ,导通损耗大概0.083W;但如果用15mΩ,损耗就是0.124W。更隐蔽的是死区时间里体二极管导通产生的损耗,死区假设200ns,频率600kHz,体二极管压降0.7V,那么损耗大约是0.7V乘以3A乘以200ns乘以600kHz,等于0.25W。这个数字比很多人预想的高,所以死区时间也不能随便设,太短怕上下管直通,太长体二极管损耗增大,驱动IC的deadtime参数要对着规格书选。
3.2 高压MOS管怎么选:Rdson、Qg、Coss与热阻
60V输入系统的MOS管耐压至少要留30%以上的降额,我一般直接选100V耐压档,这样即使开关节点振铃尖峰超过70V,管子也扛得住。确定了耐压档之后,就是Rdson和Qg的权衡,高压MOS的导通电阻和栅极电荷存在物理矛盾,Rdson越低,芯片面积越大,Qg也越大,开关损耗反而上去了。
高压侧MOS看FOM,也就是Rdson和Qg的乘积要尽量小;低压侧MOS看Rdson和体二极管特性。封装热阻同样关键,同样是100V MOS,SOP-8封装的θja可能有60℃/W,PDFN 5x6封装能到40℃/W甚至更低,同样的损耗,结温能差出20℃以上。规格书里的最大结温、θjc、θja这些参数一定要抄进你的计算表里。
另外,不要盲目追求超低Rdson而忽略Coss和米勒电容。高压侧MOS的Coss过大会造成开通瞬间的电流尖峰和额外损耗,米勒平台时间太长会拖慢开关速度,导致高边和低边切换时直通风险增加。我之前对比过两颗参数相近的100V MOS,一颗Qg为25nC,另一颗为45nC,同样是400kHz开关频率,后者的温升高了整整15℃,这就是栅极电荷带来的差距。
3.3 栅极驱动设计:驱动电阻、放电电阻、自举电容
MOS管能不能按设计速度开和关,很大程度取决于栅极驱动回路设计。栅极串联电阻的作用是限制驱动电流、调节开关速度,阻值太大会增加开关损耗,太小又容易引起振铃和EMI。实际调板时,我会先在SW节点夹一个探头,用不同阻值的栅极电阻试,找到一个振铃幅值可以接受、同时开关损耗不至于飙升的平衡点。
栅极放电电阻也很重要。如果驱动芯片在MOS管栅源之间只有一个驱动输出,没有内部下拉,当驱动芯片尚未上电或输出高阻时,MOS栅极处于悬空状态,可能被外部噪声或米勒电流误导通,特别是高压输入情况下,这个风险很大。我习惯在栅源之间加一颗10kΩ到100kΩ的下拉/放电电阻,正常情况下它只漏掉微安级电流,不影响驱动波形,但能在上电瞬间把栅极锁定在关断状态。
自举电容选小了,高边MOS驱动电压不足,管子工作在放大区,发热量暴涨;选大了又会影响自举充电时间。工程上按Qg来估算,自举电容容值至少要大于栅极电荷除以允许的电压跌落,再乘一个裕量系数。我一般取0.1μF到1μF,X7R材质,靠近自举引脚和SW节点放置,走线尽量短。这个电容如果放远了,寄生电感会抬高自举回路阻抗,开关瞬间驱动波形会塌陷。
3.4 MOS周边电路与保护布局的几个细节
输入防反接电路也是60V系统里绕不开的话题。用一个P-MOS做防反接,栅源电压在反接时被钳位,管子不导通,从而切断电路;用N-MOS做低边防反接也行,但要注意体二极管方向和控制逻辑。我之前图省事在输入串联了一个二极管,结果大电流下损耗接近1W,后来换成P-MOS防反接,导通损耗降了两个数量级,这在高输入电流场景下非常值得。
还有就是要检查后级负载带来的反射干扰。我的12V输出要驱动一个小的H桥去控制直流电机,H桥上下管切换时会产生很大的电流突变和EMI,反过来污染12V母线,甚至导致前面的降压芯片环路不稳定。后来我在12V输出上增加了一级LC滤波,并且把H桥的PWM频率和降压芯片的开关频率错开,问题才解决。做这种多路电源系统,不能只看电源芯片本身,还要把后级负载的动态特性考虑进来。
4. PCB热设计与散热布局:热量能不能散出去全看这几步
4.1 散热路径规划:芯片的热焊盘、过孔和底层铜箔
电源芯片的热主要靠封装底部的裸露焊盘导出,这个焊盘必须大面积连接到PCB铜皮,而且要通过过孔阵列把热量导到另外一层甚至底层,单靠顶层一小块铜皮根本散不掉。以常见的QFN封装为例,热焊盘下方我通常打9到16个0.3mm孔径的过孔,间距1.0mm到1.2mm,孔内镀铜,过孔直接连到底层大面积地铜皮。
底层铺铜不是随便铺一块就行,要尽量保证这一层是完整的地平面,并且通过过孔和顶层功率地连接。铜皮的厚度和面积决定了热阻能降到多少,一块完整的2oz铜皮散热效果比1oz要好接近40%。估算结温时用公式:Tj等于环境温度加θja乘以总损耗,比如某芯片θja在良好散热设计下是30℃/W,整板损耗3W,那么55℃环境下结温就是55加90等于145℃,已经超了,说明要么继续降低损耗,要么加大散热面积、加散热器、甚至加风扇。
还要提醒一句,热过孔不要打在焊盘正中央太集中,否则焊接时焊锡会沿过孔流走,造成虚焊。我一般让过孔稍微分散,并且在过孔背面用阻焊开窗,方便手工补锡。对于大电流回路,输入电容、高边MOS、低边MOS和电感之间的走线要短而宽,宽度不够的铜皮本身就是电阻,会在满载时发热,这个发热往往被很多人忽略。
4.2 电感与MOS的布局距离和方向
电感在PCB上的位置不只是“放在SW节点旁边”这么简单,它的磁场会向四周辐射,对邻近的反馈走线和敏感信号产生干扰。我一般把功率电感和MOS管先摆成一个紧凑的功率回路,输入电容靠近高边MOS的漏极和低边MOS的源极,电感靠近开关节点,输出电容靠近电感的输出端,整个回路的包围面积越小,EMI和寄生电感都越小。
电感的方向也有讲究,屏蔽型电感磁场泄漏小,位置相对随意;非屏蔽工字电感有开放磁路,磁场方向沿轴向,布置时要尽量让磁轴避开反馈电路、采样电阻和运放输入。反馈线要从输出电容附近单独走线,不要从电感下方穿过,最好在底层走并用GND包地。电感离MOS也不能太近,否则MOS的高频开关噪声会通过电感寄生电容耦合,导致输出纹波变差。
4.3 热成像实测与温升记录
原理计算只能算个大概,到了实测阶段一定要用热像仪和热电偶把温度点标出来。热像仪测量的时候,电感表面如果是亮漆或金属外壳,发射率会偏低,测出的温度偏小,我的做法是在测量点贴一小块黑色胶带或涂导热硅脂,把发射率设成0.95再测。热电偶可以用耐高温胶带固定在MOS管表面、电感表面、芯片壳温点,各个关键位置都布点。
实测不能只在25℃室温下测,还要在高温环境或密闭箱体里跑。我的做法是恒温箱设到55℃,板子满载跑30分钟,每5分钟记录一次各点温度,直到温度稳定。用热像仪拍照时顺便看整板温度分布,哪个区域颜色特别亮,热源就集中在哪。然后按Tj等于Tc加θjc乘以损耗来估算结温,Tc是壳温,θjc从规格书里查,这个估算值如果超过125℃就要立刻优化。
我遇到过一种情况,计算和热像仪显示MOS管温度只有85℃,看起来没超标,但持续跑了一个小时后芯片过热保护了。后来发现是芯片底部热焊盘过孔太少,热导到内层就断了,芯片壳温不高,但结温已经飙上去。所以光看表面温度还不够,热设计验证必须以芯片内部结温为准。
4.4 高压降压电源常见问题速查表
项目调试过程里总会遇到各种奇怪问题,我把最常遇到的整理成了一个表,方便后面做类似项目时快速定位。
| 问题现象 | 可能原因 | 排查方向 | 解决办法 |
|---|---|---|---|
| 上电就炸芯片 | 输入过压尖峰超标、电感饱和、环路振荡 | 示波器看输入电压和SW波形,确认电感峰值电流 | 输入加TVS和RC吸收,增大电感或换饱和电流更大的电感,上电串限流电阻 |
| 芯片过热保护 | 热焊盘虚焊、散热过孔太少、开关频率过高 | 看芯片壳温、过孔阵列完整性,测效率曲线 | 补焊热焊盘,增加过孔和底层铜皮,降低开关频率 |
| MOS管异常烫手 | 驱动太慢、栅极电阻过大、死区设置不当 | 用示波器看栅极波形和SW上升下降沿 | 调小栅极电阻,优化死区时间,检查自举电容容量 |
| 电感啸叫 | PFM轻载模式、环路不稳定、MLCC压电效应 | 听声源位置,测SW波形和负载瞬态 | 强制PWM模式,调整补偿参数,换低噪声MLCC |
| 输出纹波偏大 | 输出电容ESR太高、环路带宽不足、功率回路过大 | 测纹波频谱,看SW振铃,检查输出电容摆放 | 换低ESR电容,增加前馈电容,缩小功率回路 |
| 轻载输出电压偏高 | 芯片最小导通时间受限,占空比降不下去 | 测SW波形是否出现漏脉冲 | 加假负载,或换支持更低最小导通时间的芯片 |
实际操作里,我觉得最有用的一个技巧是“先算后测再改”
很多工程师习惯画完板子就测,测出问题再改,效率很低。我在这个项目里养成的习惯是:选型阶段把每一路损耗列一个excel表,把输入电压、负载电流、占空比、开关频率、Rdson、Qg、DCR全部填进去,算出预计损耗和温升,再对照散热条件看是否超标。虽然计算值跟实测有偏差,但至少能帮你提前锁定最大的发热源,是电感、高边MOS还是低边MOS,不至于上电后大海捞针。
实测时也别只看稳态温升,还要做负载动态测试,用电子负载在0到满载之间跳变,看电感电流是否出现过冲,输出电压是否稳定。高压差降压里,负载突变瞬间可能让电感电流失控,一旦超过饱和点,电感量骤降,电流继续猛增,温度立刻起飞,这种失效模式在静态测试里看不出来。
做这个60V降压项目,我最大的体会是:高压差降压的热设计,不要把精力全放在散热片上,先把开关频率、MOS管选型、电感饱和电流这些“热源头”抠明白,再谈散热铜皮和过孔。散热布局是在源头损耗已经控制住的基础上做的“锦上添花”,如果源头损耗太大,你贴再大的散热片也压不住。回到标题里那三个词:电感、MOS、散热布局,它们不是三个独立的设计点,而是一条完整的热链路。电感饱和电流留够、MOS的开关损耗压住、散热路径能顺利把热导到环境中,这个60V转多路低压的电源才算真的能交付。