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简介：面向高精度模拟信号链设计人员、硬件工程师及电子竞赛备赛者，这套基于LTC2756、LTC6244、LTC6655的18位乘法串行输入电流输出数模转换器模块工程文件，从原理图到PCB完整呈现了高分辨率模拟输出通道的典型设计。该模块采用四层板工艺，板卡尺寸设置为66毫米乘39毫米，可适用于精密仪器、数据采集、工业控制等需要低噪声、高线性度模拟输出的应用场景。压缩包内共包含13个文件，以Altium Designer工程文件为框架，其中包括两款原理图文档、两款PCB文档、对应的元件库与集成库，以及预览文档、结构文件和一枚Excel清单，包体大小约902KB。工程文件组织结构清晰，便于快速检索和复用。当前已有166人学习下载，适合作为学习高精度DAC电路设计和模拟PCB布局布线的参考范例。通过研读这套工程，可详细了解LTC2756电流输出DAC与LTC6244运放、LTC6655精密基准源的信号连接和电源退耦方式，并借鉴四层板地平面分割与模拟走线策略，有助于缩短自主设计中的排查时间与开发周期。 做高精度模拟源的时候，16位DAC有时候真不够用。10V满量程下16位对应152µV一个码，听起来很小，可一旦带负载、温度变化，有效精度很容易缩水到14位以下。所以我一直在找一个能稳住的方案，这次直接用18位串行乘法电流输出DAC LTC2756做核心，配合双路低噪声运放LTC6244和超低噪声基准LTC6655，完整画了一块独立模块。LTC2756负责真正的18位分辨率，LTC6244把电流输出干净地变成电压，LTC6655不拖后腿地提供参考电压源。这篇记录整个设计过程：从三颗芯片的分工逻辑、原理图细节，到PCB布局布线的具体处理，再到打样后实测遇到的各种问题，希望对正在选型或者纠结布局的工程师有点帮助。

1. 为什么是三颗芯片的组合：18位DAC模块的选型思路

1.1 现成模块的遗憾与DIY的出发点

市面上能买到的DAC模块多数以16位为主，真正标称18位的模块少且贵。更麻烦的是，模块的输出范围、基准电压、滤波特性都是厂家固化的方案，想调整到适合自己的系统非常困难，layout也已经定死，无法针对高精度需求做专项优化。与其被模块约束，不如自己画板子，把核心器件握在手里，每一处走线、每一个去耦电容都能按18位精度的要求去处理。

设计目标我定得很明确：单极性0~2.5V输出，基准选LTC6655-2.5。18位分辨率下，1LSB是2.5V除以262143，约等于9.5µV。这个量级的电压变化意味着系统噪声预算必须控制在几个µV以内，电源纹波、地噪声、数字串扰都可能直接淹没信号。正因为目标这么紧，芯片选型才不敢含糊，三颗芯片各管一段，形成一条完整的高精度链路。

1.2 LTC2756：电流舵架构与内部校准是精度基石

LTC2756最吸引我的两点：一是内部集成了精密电阻网络，二是电流舵架构天然适合高精度。它是一款18位无失码的乘法DAC，INL典型值在±1LSB左右，这样的线性度指标靠外部搭电阻网络几乎不可能实现，因为要匹配到18位级别，分立电阻的成本和面积都不可接受。

电流舵架构的核心是输出电流信号而不是电压信号，精度不直接受运放输出级影响，但代价是必须有外部I-V转换电路。好在LTC2756内部有配套的反馈电阻，外部只需加运放就能得到不同输出范围。它还支持软件可编程的四象限乘法模式，VREF除了直流电压外，也能输入AC信号用于增益调整和波形衰减应用。

内部校准电路是这颗DAC区别于普通型号的重要特性。18位DAC出厂时的失调误差和增益误差虽然不大，但高精度场合照样会吃掉几个LSB。LTC2756可以在系统层面做校准，把残余误差压到更小，这也是我选它而不是普通18位DAC的原因。

1.3 LTC6244与LTC6655：I-V转换和基准源的搭配逻辑

I-V转换运放层面，LTC6244是双路低噪声CMOS运放，噪声典型值7nV/√Hz，增益带宽积50MHz，输入偏置电流在pA级别。I-V转换最关心两件事：低噪声和低偏置电流。偏置电流流过反馈电阻会产生直流误差，即便反馈电阻用到10kΩ，pA级偏置电流带来的误差也只有几十nV，完全可以忽略。50MHz带宽对DAC输出信号的建立时间也有保证，不会在切换码值时拖泥带水。

LTC6655则是超低噪声精密基准源，0.1Hz到10Hz的噪声典型值在0.3ppm量级，温漂系数低至个位数ppm/°C。基准噪声是整个系统的底线——DAC自身的量化噪声已经很干净了，如果基准在输出端抖动，那就是给所有代码叠加了一个公共噪声源。以2.5V基准为例，0.3ppm对应的噪声大约0.75µV，这才能匹配9.5µV的LSB。

简单说，三颗芯片的分工很明确：LTC2756负责分辨率和线性度，LTC6244负责把电流无失真地转换成电压，LTC6655负责提供一个足够干净的"尺子"。缺一不可，任何一颗拖后腿，整个模块的精度表现都会打折扣。

2. 原理图设计：从SPI时序到模拟链路的每一处细节

2.1 电源树设计：数字、模拟与基准各走各路

18位系统对电源的要求不是"能工作"这么简单，而是纹波和噪声必须在µV级别。我的做法是整块板子用三路LDO：数字电源单独一路，给LTC2756的DVCC和MCU侧供电；模拟电源一路，给AVCC和LTC6244；基准输入电源甚至单独用一路低噪声LDO。

LTC2756的AVCC和DVCC引脚虽然是分开的，但物理上还是一颗芯片，数字噪声很容易通过共用衬底耦合到模拟部分。所以两个电源引脚必须分别接不同容值的去耦电容，AGND和DGND在芯片下方用单个焊盘汇合到一个地平面，避免形成地环路。LTC6244的电源去耦同样不能省，100nF陶瓷电容放在电源引脚旁边，10µF钽电容放在稍远位置，覆盖不同频段的去耦需求。

LTC6655的输出端我加了一级RC滤波，实测对基准噪声抑制效果明显。取值上建议用10Ω电阻串10µF电容，极点频率约1.6kHz，既能滤掉宽带噪声又不会带来明显的建立时间问题。注意基准芯片的输入电源质量同样影响输出噪声，不要用开关电源直接供电，LDO的电源抑制比在高频段会逐渐下降，必要时可以再加一级LC滤波。

2.2 I-V转换电路计算：增益、补偿与输出范围

以0~2.5V单极性输出为例，VREF取2.5V，LTC2756内部R-2R网络的等效电阻是10kΩ，因此满量程输出电流约250µA。这个电流经过反馈电阻转换成输出电压，如果反馈电阻也是内部10kΩ匹配电阻，运放输出端就得到约2.5V满量程电压。实际极性取决于ROFS引脚的接法，数据手册给出了多种参考电路，单极性正输出、双极性正负输出都能通过换接法实现，我在原理图里把ROFS和VREF的连接做成跳线选择，方便调试时切换。

反馈电容的选择会影响I-V转换的稳定性。运放反相输入端对地存在DAC输出电容和运放输入电容，加起来可能有几十pF，这会引入一个极点，导致闭环不稳定。标准做法是在反馈电阻两端并联一个几pF的补偿电容，我用1pF起步，观察输出波形是否有振铃，没有振铃就保持，有的话再微调。电容太小会欠补偿，输出有尖峰；电容太大会吃掉带宽，使DAC切换后的建立时间变长。这个值没有固定答案，跟layout寄生参数有关，必须实测调整。

LTC6244是双通道运放，一路做I-V转换，另一路可以留作输出缓冲、反相或者二阶滤波，我的板子上第二路做了单位增益缓冲再送到输出连接器，这样外部负载不会直接影响主运放的工作状态。

2.3 SPI接口与菊花链：数据正确进入18位寄存器

LTC2756是串行输入接口，18位数据宽度，SPI兼容，最大时钟频率50MHz，CLK上升沿采样数据。MCU侧我预留了3.3V和5V两种电平兼容配置，因为DAC的数字引脚允许范围较宽，但最好还是根据主控单片机的电平来匹配。CS引脚低电平有效，所有时钟活动都必须在CS拉低之后进行，数据按MSB先出的顺序送入。

CLR引脚是异步清零，低电平有效，调试阶段我建议先拉高禁用，避免上电瞬间意外清空DAC寄存器。DOUBLECHARGE引脚控制DAC输出瞬态性能：置高可以加快转换速率但会增加毛刺，置低则毛刺更小但建立稍慢，高精度测量场景优先选择低毛刺模式。如果以后要扩展多通道，LTC2756的SDO引脚支持菊花链级联，后一片的DIN接前一片的SDO就可以共用同一组SPI总线，这个功能在原理图阶段就要把SDO引出来，不然后期飞线很痛苦。

3. PCB布局布线：18位精度是画出来的，不是焊出来的

3.1 层叠结构与完整地平面的优先级

这块板子我直接用四层：顶层信号、第二层完整地平面、第三层电源平面、底层信号。核心原则是第二层地平面绝不分割。很多工程师习惯把模拟地和数字地在平面上直接切开，美其名曰"隔离"，实际上地平面一旦被切断，回流路径立刻变长，等于人为制造了一个大天线。

高频信号的回流电流永远走阻抗最小的路径，也就是信号线下方的地平面投影区域。如果地平面被切开，回流只能绕一个大圈，环路面积变大的后果是既容易被外界噪声耦合进来，也容易把DAC自身的数字开关噪声辐射出去。在18位系统里，这种噪声很容易超过µV级，直接毁掉整个精度设计。

正确的做法是器件分区：数字器件和数字走线集中布局在板子左侧，模拟器件放在右侧，中间不需要物理隔离槽，地平面保持连续即可。电源平面分成几个区域分别走AVCC和DVCC，注意电源平面边缘不要出现狭长的孤岛，那是噪声的聚集地。

3.2 模拟与数字分区：让回流电流有路可走

SPI数字线从连接器进入板子后，先经过数字器件区域，再走到LTC2756的数字引脚侧，不要横穿模拟区。LTC2756的底部有裸露焊盘，必须可靠接地，这个焊盘既是散热通道也是电气连接点，PCB封装里一定要给够散热过孔，推荐在焊盘中心区域打9个左右的过孔阵列，孔径0.3mm，过孔不要盖油，否则焊接时气泡会把芯片顶起来。

运放和基准必须放在DAC的模拟侧，尽量靠近IOUT和VREF引脚。反馈路径大部分在DAC内部完成，外部走线只有IOUT到运放反相输入端这一小段，这段线越短越好，宽度可以适当加粗到10mil以上，减小寄生电阻和电感。运放的反馈电阻到输出连接器之间走线保持畅通，避免被数字走线夹在中间。

3.3 基准与输出高阻节点的走线保护策略

基准输出到DAC VREF引脚的距离直接决定基准信号收到的干扰程度。这条线我做了包地处理，两侧各有一条地线保护，间距保持2倍线宽以上。包地的意义是让邻近的电场耦合通过接地线泄放掉，而不是耦合到基准线上。数字时钟信号和DIN数据线严禁与基准走线平行，尤其不能长距离平行。

运放反相输入端是整个板子上最敏感的高阻节点，它接收DAC的微小电流信号，任何耦合进来的电荷都会变成电压误差。除了缩短走线，我还在这个节点周围加了一圈环形地线做保护环，把高阻节点完全围起来。保护环的电位是地，相当于给敏感节点穿了一层"法拉第笼"，实测对毛刺抑制有明显改善。

ROFS引脚的走线同样需要注意，它决定了DAC的输出范围精度，最好也做成短而粗的走线，不要穿其他信号过孔。

3.4 去耦电容摆放的实测心得

电源去耦电容的位置比容值更重要。100nF陶瓷电容必须放在电源引脚1mm以内，走线先过电容再到引脚，这样高频电流路径最短。10µF大电容可以放在2~3mm外，负责低频段的能量存储。这个"先小后大"的摆放方式我实测下来比反过来要好得多，原因是小电容的ESL低，高频阻抗低，离引脚越近效果越好。

基准输出端的RC滤波电容我用了C0G材质的陶瓷电容。X7R电容在直流偏压下容值会衰减到标称值的一半以下，C0G几乎没有这个问题，而且压电效应低得多。另外这个电容不要贴在板边或者靠近安装孔的位置，因为PCB板在应力下会产生微小的机械形变，C0G电容虽然压电效应小，但任何微振动都会在ADC或者DAC系统里留下痕迹，物理隔离是最后的屏障。

4. 打样、焊接与实测调试中的真实问题

4.1 首次上电先查什么：基准源与电源纹波

板子回来后先别急着焊LTC2756，那是最贵的器件，要先确认周边环境没问题再上。我只焊LTC6655和LTC6244，上电后第一时间用万用表量基准输出，应该稳定在2.5V。然后用示波器AC耦合档看基准的纹波和毛刺，如果看到几百kHz以上的高频尖峰，先查基准输入端的RC滤波和LDO的输出噪声。

电源纹波检查也很关键，我习惯用示波器20MHz带宽限制，看LTC6244的电源引脚上有多少毛刺。实测发现如果毛刺超过5mV，后面DAC输出端大概率会有对应噪声。这时不要急着调DAC，先解决电源问题。LDO输出端加一级LC滤波通常能压住，或者把去耦电容的位置重新调整。

确认电源和基准干净之后，焊上LTC2756，用最小程序给DAC写全零，测量输出端电压，理论上是0V附近，接着写满量程，应该接近2.5V。这个测试能快速发现焊接问题和基本功能问题。

4.2 SPI通信排查：数据错位、时钟毛刺与时序余量

SPI通信是调试阶段最常见的坑。如果你的MCU SPI配好了但输出没反应，先别怀疑DAC坏了，按照下面顺序排查：

我第一次调试时遇到的现象是写入0x3FFFF后输出只在中间值，排查半天发现是CPOL配置反了，DAC在下降沿采样，而MCU按照上升沿发送，导致数据每bit错位。后来把SPI模式改过来，输出立刻正常。CLK走线如果跨过模拟区，还可能出现数据偶发错误，这时候把速率降下来最有效，毕竟18位数据量不大，低速并不影响实际使用。

4.3 线性度和噪声验证：如何判断板子是否达标

基础功能正常后，需要验证模块的真实精度。没有24位ADC的话，用台式六位半万用表也可以测得比较合理的数据。方法很简单：写一个斜坡程序，从0递增到满量程，每步间隔50ms让输出稳定，记录万用表读数，观察步进是否均匀。18位的9.5µV步进，六位半万用表（分辨率100nV级别）完全能分辨出来。

噪声验证分两步。第一步看静态噪声：固定输出中间码，用示波器AC档看输出噪声幅度，正常应该在几十µV以内。如果看到低频缓慢漂移，多半是基准的问题；如果看到高频毛刺，可能是电源去耦不足或者数字串扰。第二步做全码范围扫描：从全零到满量程分几十个点测量，把INL误差画出来，如果出现周期性波浪，那通常是基准或电阻网络的热梯度问题，检查板子上有没有局部过热点。

实测中我发现一个问题：输出在中间码附近会出现周期性的台阶，像阶梯状噪声。排查后确认是数字地回流路径没有处理好，SPI信号线下方恰好在模拟区附近有过孔换层，回流路径绕了远路，把数字噪声带进了模拟信号通路。调整布局后这个现象基本消失，这也印证了前面说的：地平面完整比什么都重要。

如果让我重新做一版，我会把SPI接口和模拟输出之间的隔离再加强一些，直接用隔离芯片把数字侧完全隔开，这样数字噪声连进入模拟区的机会都没有。另外测试时建议先把SPI速率降到1MHz做功能验证，排除layout串扰因素后再提速度，可以省下很多排查时间。18位DAC不是焊完就有18位精度，layout、电源、基准缺一不可，每一处细节都在决定最终你能不能拿到那几个µV。

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