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简介：本资源是面向嵌入式开发工程师与DSP初学者的TMS320C6713处理器SDRAM驱动实践项目，聚焦于解决高性能浮点DSP系统中高速外部存储器的初始化、配置与可靠读写问题，适用于音频处理、实时通信等对内存带宽与时序敏感的嵌入式应用场景。压缩包共17个文件，含核心C源码（main.c）、头文件（.h）、工程配置（.pjt、.cmd、.paf2）、链接命令（.lkf）、编译输出（.out、.map、.sbl）及调试日志（.log），辅以数据库索引文件（.dbf/.cdx/.fpt）支持Code Composer Studio环境下的符号调试与工程管理，整体体积仅48KB，轻量实用。已有84人学习下载，资源结构完整，覆盖SDRAM控制器寄存器配置、模式寄存器加载、行/列地址时序控制、突发读写实现及自动刷新机制等关键环节，可直接导入CCS构建调试，是理解C6713外设内存接口原理与工程落地的典型参考范例。

1. 项目缘起：为什么要在DSP上折腾SDRAM？

最近在整理一个老项目的资料，翻出来一个名为“SDRAM.rar_6713读写sdram_sdram”的压缩包。看到这个文件名，估计不少搞过嵌入式，特别是用过TI老款DSP的朋友会心一笑。这名字一看就是典型的“工程文件”，把核心器件（TMS320C6713）、核心功能（读写SDRAM）和核心文件（SDRAM.rar）一股脑儿堆在一起，充满了那个年代工程师的“实用主义”风格。

这个压缩包背后，其实是一个在DSP开发中非常经典且基础的问题：如何为高性能的浮点DSP（TMS320C6713）扩展足够大且高速的外部存储器。C6713本身片内RAM有限，要处理复杂的算法（比如音频编解码、图像处理、通信基带），数据量一大，片内那点空间根本不够用。这时候，SDRAM就成了性价比最高的选择——容量大（动辄32M、64M甚至128M）、速度相对较快、价格便宜。

但“读写SDRAM”这四个字，说起来简单，做起来却是一连串的坑。它绝不仅仅是写几行memcpy那么简单。你需要正确配置DSP的EMIF（外部存储器接口）控制器，理解SDRAM的初始化序列、刷新机制、时序参数，还要处理好DSP高速内核与相对较慢的SDRAM之间的速度匹配问题。很多新手第一次调SDRAM，程序一跑就飞，或者数据读写不稳定，问题往往就出在这些底层细节上。

所以，今天我就以这个“SDRAM.rar”为引子，结合TMS320C6713，把SDRAM从硬件连接到软件驱动，再到实际应用中的注意事项，彻底拆解一遍。无论你是正在学习DSP的新手，还是遇到了类似问题的同行，希望这篇从实战中总结出来的长文能帮你避开我当年踩过的那些坑。

2. 硬件基石：C6713的EMIF与SDRAM芯片选型连接

在写第一行代码之前，硬件连接是基础中的基础。这一步错了，软件调死也没用。

2.1 理解C6713的EMIF控制器

TMS320C6713的EMIF（External Memory Interface）是一个强大的外部存储器接口控制器，它支持多种存储器类型，包括SDRAM、SBSRAM、异步存储器（如Flash、SRAM）。对于SDRAM，EMIF提供了专用的控制信号线和配置寄存器。

你需要关注EMIF的几个关键信号组：

• 地址总线 (EA[21:2])：注意，EMIF的地址总线是字节地址，但对接SDRAM时，需要根据SDRAM的位宽进行转换。对于最常见的32位数据总线、4个Bank的SDRAM，EA[21:2]中的高位（如EA[21:12]）可能映射到SDRAM的行地址（RA），中间位映射到列地址（CA），最低几位（EA[3:2]）在32位系统下通常不用，因为一次访问4字节。
• 数据总线 (ED[31:0])：32位宽度，与C6713的CPU位宽一致，提供高效的数据吞吐。
• 控制信号：
  • SDRAS：SDRAM行地址选通。
  • SDCAS：SDRAM列地址选通。
  • SDWE：SDRAM写使能。
  • CLKOUT2：EMIF输出给SDRAM的时钟信号，SDRAM的所有操作都同步于这个时钟。
  • CE0/CE1等：片选信号，用于选择不同的外部存储器空间。SDRAM通常连接在CE0空间。
• SDRAM专用信号：
  • DQM[3:0]：数据掩码，对应32位数据的4个字节，在读写时用于屏蔽不需要的字节。
  • BA[1:0]：SDRAM的Bank地址线。

理解这些信号是正确配置寄存器和阅读芯片手册的前提。

2.2 SDRAM芯片选型与电路设计要点

当时与C6713搭配的SDRAM，常见的是单片32Mbit（4M x 8bit）或64Mbit（8M x 8bit）的芯片，通过位扩展（如4片8位芯片并联）组成32位宽度。

选型时关键看这几个参数：

1. 容量与组织方式：例如，一颗MT48LC4M32B2芯片，解读为：4M（行地址数） x32（位宽）x4 Banks。总容量 = 4M * 32bit * 4 = 512Mbit = 64MB。这正好可以单片组成32位数据宽度，简化设计。
2. 速度等级：如-7E代表143MHz（周期约7ns），-75代表133MHz。必须确保SDRAM的速度等级高于或等于EMIFCLKOUT2的输出频率。如果DSP主频是225MHz，EMIF时钟可能是主频的一半（112.5MHz），那么选择-7E（143MHz）的芯片是安全的。
3. 供电电压：C6713是3.3V I/O，所以SDRAM也应选择3.3V LVTTL接口的型号。

电路设计上的坑：

• 上拉电阻：SDRAS、SDCAS、SDWE等控制线通常需要加上拉电阻（如4.7KΩ）到3.3V，确保初始状态为高电平。
• 时钟信号：CLKOUT2到SDRAM的时钟输入（CLK）的走线必须等长、短且干净，最好做包地处理，避免信号完整性问题导致读写错误。
• 电源去耦：SDRAM是动态器件，刷新和读写操作瞬间电流变化大。必须在每颗SDRAM芯片的电源引脚附近放置足够多的去耦电容（如0.1uF和10uF组合），这是稳定工作的生命线。我见过太多因为去耦电容不足或摆放太远导致的随机性数据错误。
• 端接电阻：如果总线频率较高（>100MHz）或走线较长，数据总线和地址总线可能需要考虑串联端接电阻（22Ω-33Ω），以抑制反射。这在早期的两层板设计中尤其需要注意。

注意：原理图设计时，务必把SDRAM芯片的数据手册和C6713的 datasheet、EMIF应用报告放在一起对照着画。重点核对引脚顺序、电源网络、控制信号的连接关系。我曾经因为把BA0和BA1接反了，导致只能访问一半的Bank，排查了大半天。

3. 软件驱动核心：EMIF配置与SDRAM初始化序列

硬件OK了，接下来就是让软件“认识”并“驱动”这片SDRAM。这是整个环节中最需要耐心和细致的一步。

3.1 EMIF全局控制寄存器（GBLCTL）与CE空间控制寄存器（CExCTL）

C6713的EMIF配置主要通过一组内存映射的寄存器完成。首先需要配置的是EMIF全局控制寄存器（EMIF_GBLCTL）和对应CE空间的控制寄存器（例如EMIF_CE0CTL，因为我们假设SDRAM接在CE0空间）。

EMIF_GBLCTL配置要点：

• 设置EMIF时钟使能：确保EMIF模块的时钟被使能。
• 配置CLKOUT2输出：选择CLKOUT2的时钟源和分频比。例如，如果DSP内核时钟（CCLK）是225MHz，我们可以设置CLKDIV=1，让CLKOUT2 = CCLK / 2 = 112.5MHz，作为SDRAM的工作时钟。
• 其他全局参数：如总线保持器（Bus Holder）的使能等。

EMIF_CE0CTL配置要点（这是重头戏）：这个寄存器定义了CE0空间所接存储器的类型、时序参数。对于SDRAM，需要配置一个专门的SDCTL寄存器（与CE0CTL是同一个寄存器地址，但位域含义不同）。

// 以下是一个针对112.5MHz EMIF时钟，连接64MB SDRAM的示例配置思路 // 具体寄存器地址和位域定义请参考TI的TMS320C6000 EMIF用户指南 void configure_emif_for_sdram(void) { // 1. 配置全局控制，使能EMIF并设置CLKOUT2 EMIF_GBLCTL = (1 << EMIF_ENABLE_BIT) | (CLKDIV_2 << CLKOUT2_DIV_BIT); // 2. 配置CE0空间为SDRAM接口，并设置关键时序参数（数值需要根据具体SDRAM芯片手册计算） EMIF_CE0CTL = ( MTYPE_SDRAM << MTYPE_BIT | // 存储器类型：SDRAM (TRCD - 1) << TRCD_BIT | // RAS到CAS延迟（例如：2个时钟周期，填1） (TWR - 1) << TWR_BIT | // 写恢复时间（例如：2个时钟周期） (TRRD - 1) << TRRD_BIT | // 行到行激活延迟 (TRC - 1) << TRC_BIT | // 行周期时间 (TRAS - 1) << TRAS_BIT | // 行激活时间 (TREF - 1) << TREF_BIT | // 刷新周期（基于CLKOUT2计算） (TRP - 1) << TRP_BIT | // 行预充电时间 SDWID_32BIT << SDWID_BIT | // SDRAM数据位宽：32位 SDRS_4BANKS << SDRS_BIT | // SDRAM Bank数：4 RFEN_ENABLE << RFEN_BIT // 使能EMIF自动刷新 ); // 注意：上述TREF（刷新周期）的计算是关键。 // SDRAM通常要求每64ms刷新8192行。刷新间隔 = 64ms / 8192 ≈ 7.8125us。 // 如果CLKOUT2周期Tclk = 1/112.5MHz ≈ 8.889ns。 // 那么，刷新计数器应设置为：7.8125us / 8.889ns ≈ 879 (0x36F)。 // EMIF的TREF位域通常是这个计数值减去1。 }

时序参数计算是核心难点：所有TRCD、TRP、TRC、TRAS等参数，单位都是CLKOUT2的时钟周期数。它们的最小值必须满足SDRAM芯片手册中对应参数（单位是纳秒）的要求。例如，芯片手册要求tRCD (min) = 20ns。我们的Tclk=8.889ns，那么TRCD至少需要ceil(20ns / 8.889ns) = ceil(2.25) = 3个时钟周期。所以在配置寄存器时，TRCD字段应填入3 - 1 = 2。

3.2 执行SDRAM上电初始化序列

仅仅配置好EMIF寄存器，SDRAM还不能用。必须严格按照JEDEC标准，执行一次性的上电初始化序列。这个序列由EMIF硬件自动完成，但需要软件通过向特定地址执行“虚写”操作来触发。

#define SDRAM_BASE_ADDRESS 0x80000000 // 假设SDRAM映射在CE0空间，起始地址0x8000_0000 void sdram_init_sequence(void) { volatile Uint32 *sdram_ptr = (volatile Uint32 *)SDRAM_BASE_ADDRESS; Uint32 dummy; // 步骤1: 等待上电稳定（通常至少200us）。软件延时或利用其他定时器。 delay_us(200); // 步骤2: 发送预充电所有Bank命令。通过向任意地址执行一次写操作来触发。 // EMIF会在内部将其解释为“预充电”命令。 *sdram_ptr = 0; // 步骤3: 发送至少2个（通常是8个）自动刷新命令。 // 同样通过多次“虚写”触发。 for(int i = 0; i < 8; i++) { dummy = *sdram_ptr; // 一次读操作也可触发刷新，但写操作更常见 // 或者 *sdram_ptr = 0; } // 步骤4: 发送模式寄存器设置(MRS)命令。 // 这是最关键的一步，告诉SDRAM它的工作模式（突发长度、CAS延迟、突发类型等）。 // 通过向一个特定的地址（包含了模式寄存器设置值）进行写操作来触发。 // 地址线A[10:0]上的值在MRS周期被锁存进SDRAM的模式寄存器。 // 假设我们需要设置：突发长度=4， CAS延迟=2， 顺序突发。 // 对应的MRS值需要根据SDRAM手册和EMIF地址映射来计算。 volatile Uint32 *mrs_address = (volatile Uint32 *)(SDRAM_BASE_ADDRESS | MRS_OPCODE_ADDRESS); *mrs_address = 0; // 步骤5: 再次发送预充电命令（可选，但建议）。 *sdram_ptr = 0; // 步骤6: 使能EMIF的自动刷新（如果之前没在CExCTL中使能）。 // 通常已在CExCTL中配置RFEN=1。 // 步骤7: 等待初始化完成，可以开始正常读写。 // 简单的验证：向SDRAM起始地址写入一个已知模式，再读回比较。 *sdram_ptr = 0x12345678; if(*sdram_ptr != 0x12345678) { // 初始化失败处理 } }

实操心得：这个初始化序列非常“脆弱”。其中最大的一个坑是步骤4的MRS地址计算。这个地址不是随意的，它需要根据EMIF的地址引脚与SDRAM地址引脚的映射关系，以及你想要设置的模式寄存器值来共同决定。TI的文档里通常有一个公式，但很容易算错。最稳妥的方法是参考TI官方EVM板的示例代码，看看他们是怎么算的，然后根据自己的硬件连接做调整。很多“能读不能写”或者“只能访问前一半地址”的怪问题，根源都在MRS设置不对。

4. 数据搬运实战：从简单测试到DMA优化

初始化成功后，我们就可以像使用普通内存一样使用SDRAM了。但如何高效使用，又是另一门学问。

4.1 基础读写测试与常见问题排查

首先，一定要做一个全面的内存测试，而不是只测开头一个地址。

bool test_sdram_range(Uint32 start_addr, Uint32 size_bytes) { volatile Uint32 *ptr = (volatile Uint32 *)start_addr; Uint32 num_words = size_bytes / 4; Uint32 pattern; bool pass = true; // 测试1：递增写，顺序读 for(Uint32 i = 0; i < num_words; i++) { ptr[i] = i; // 写入地址值本身 } for(Uint32 i = 0; i < num_words; i++) { if(ptr[i] != i) { printf("Error at addr 0x%08x: wrote 0x%08x, read 0x%08x\n", &ptr[i], i, ptr[i]); pass = false; // 可以在这里break，但测试时最好记录所有错误 } } // 测试2：走棋盘测试（Checkerboard），检测相邻单元干扰 pattern = 0xAAAAAAAA; for(Uint32 i = 0; i < num_words; i++) { ptr[i] = (i % 2 == 0) ? pattern : ~pattern; } for(Uint32 i = 0; i < num_words; i++) { Uint32 expected = (i % 2 == 0) ? pattern : ~pattern; if(ptr[i] != expected) { /* ... 错误处理 ... */ } } // 测试3：随机模式测试，使用伪随机数 srand(0); for(Uint32 i = 0; i < num_words; i++) { ptr[i] = rand(); } srand(0); for(Uint32 i = 0; i < num_words; i++) { if(ptr[i] != rand()) { /* ... 错误处理 ... */ } } return pass; }

测试失败如何排查？

1. 固定位错误（总是某一位出错）：可能是数据线连接问题（虚焊、短路）、DQM掩码信号配置错误，或者SDRAM芯片的某个数据位损坏。
2. 地址相关错误（只在特定地址段出错）：检查地址线连接，特别是高位地址线。使用“地址线测试”（向2的幂次方地址写独特模式）来定位是哪根地址线有问题。也可能是Bank地址线（BA0, BA1）接反。
3. 随机性、间歇性错误：最头疼。首先怀疑电源完整性和信号完整性。用示波器测量SDRAM的电源引脚（尤其是去耦电容处）和时钟线CLKOUT2，看是否有过大的噪声或振铃。其次，检查时序参数（TRCD,TRP等）是否配置得太紧张，尝试增加1-2个时钟周期的裕量。最后，考虑刷新问题，检查TREF刷新间隔设置是否正确，或者尝试在软件中定期强制刷新。
4. 写入后立即读取正确，但稍后读取错误：典型的数据保持问题，与刷新强相关。确保EMIF的自动刷新（RFEN）已使能，且刷新间隔TREF设置正确。如果问题在高温下更易出现，则更可能是刷新问题。

4.2 利用EDMA高效搬运数据

对于C6713这种高性能DSP，用CPU（C6000内核）通过memcpy循环来搬运大块数据是极大的性能浪费。C6713集成了强大的EDMA（Enhanced Direct Memory Access）控制器，可以在不占用CPU核心的情况下，在片内存储器（L2 SRAM）、片外SDRAM、外设（如McBSP）之间高速搬运数据。

一个典型的EDMA从SDRAM搬数据到片内L2 SRAM的配置示例：

#include <c6x.h> #include <csl_edma.h> #include <csl_emif.h> // 假设使用Chip Support Library (CSL) void setup_edma_sdram_to_l2(Uint32 sdram_src_addr, Uint32 l2_dst_addr, Uint32 size_bytes) { EDMA_Handle hEdma; EDMA_Config config = {0}; // 1. 初始化EDMA模块（如果尚未初始化） EDMA_init(); // 2. 打开一个EDMA通道（例如通道0） hEdma = EDMA_open(EDMA_CHA_TCC0, EDMA_OPEN_RESET); // TCC0是传输完成码，可用于中断 // 3. 配置传输参数 config.opt = 0; config.opt |= EDMA_OPT_PRI_MEDIUM; // 中等优先级 config.opt |= EDMA_OPT_TCINT_YES; // 使能传输完成中断 config.opt |= EDMA_OPT_TCCHEN_ENABLE; // 传输完成时链接到其他参数集（可选，用于循环缓冲） // 源地址：SDRAM，地址递增 config.src = sdram_src_addr; // 目的地址：L2 SRAM，地址递增 config.dst = l2_dst_addr; // 传输数量：一次传输（ACNT）16位元素，共（BCNT）个数组，每个数组（CCNT）个帧（这里简化为一维） // 假设我们搬运 size_bytes 字节的数据，且地址是32位对齐的。 Uint32 element_size = 4; // 32位 = 4字节 Uint32 acnt = element_size; Uint32 bcnt = size_bytes / element_size; config.cnt = EDMA_CNT_MAKE(bcnt, acnt); // 制作CNT寄存器值 // 索引：源和目的地址每次传输后递增ACNT（即4字节） config.idx = EDMA_IDX_MAKE(element_size, element_size); // 链接地址（这里先不链接） config.rld = EDMA_RLD_MAKE(0, 0); // 4. 将配置写入EDMA参数RAM EDMA_config(hEdma, &config); // 5. （可选）设置传输完成中断服务函数 IRQ_clear(IRQ_EVT_EDMAINT); IRQ_plug(IRQ_EVT_EDMAINT, &my_edma_isr); IRQ_enable(IRQ_EVT_EDMAINT); // 6. 启动EDMA传输 EDMA_enableChannel(hEdma); EDMA_setChannel(hEdma, EDMA_CHA_TCC0); // 将通道与TCC0关联 EDMA_triggerChannel(hEdma); // 软件触发传输开始 } // 在中断服务程序(ISR)中，需要清除事件标志，并可能重新配置/触发下一次传输 interrupt void my_edma_isr(void) { // 清除EDMA中断标志 EDMA_clearChannel(EDMA_CHA_TCC0); // ... 处理数据搬运完成后的工作 ... }

使用EDMA的优势与注意事项：

• 优势：解放CPU，CPU可以在EDMA搬运数据的同时进行算法计算，实现“计算与传输重叠”，极大提升系统吞吐率。
• 注意事项：
  • 缓存一致性：如果CPU的Cache使能了，当EDMA直接向片内L2（可能被Cache覆盖的区域）写入数据后，CPU的Cache中可能还是旧数据。需要在EDMA传输完成后，使用CACHE_invalidateL2()等函数无效化对应的Cache行，CPU才能读到新数据。反之，如果CPU写了数据到Cache，需要写回（CACHE_writeback()）到L2，EDMA才能搬走正确的数据。这是DSP编程中一个非常经典的坑。
  • 地址对齐：EDMA对传输的起始地址和传输长度通常有对齐要求（如32位对齐），不满足可能导致传输效率低下或错误。
  • 资源竞争：EDMA和CPU都要通过EMIF访问SDRAM。如果同时访问，EMIF会进行仲裁。设计时要避免两者频繁争抢总线，否则会降低整体性能。可以考虑将CPU频繁访问的数据放在片内，EDMA负责批量搬运片外数据。

5. 性能调优与稳定性加固实战经验

SDRAM能用和好用之间，隔着性能调优和稳定性加固。

5.1 EMIF带宽优化与仲裁策略

C6713的EMIF性能是有限的。优化访问模式可以榨干其带宽。

1. 利用突发传输（Burst Transfer）：SDRAM的特性决定了顺序访问（突发）远快于随机访问。确保你的数据结构（如大型数组）在内存中是连续存放的，这样CPU或EDMA访问时能触发SDRAM的页模式（Page Mode）或突发模式，减少RAS/CAS激活和预充电的开销。
2. 优化EMIF的CE空间配置：如果你还有别的存储器（如Flash接在CE1），合理设置CE1CTL的MTYPE和READY模式，避免EMIF在访问不同速度的存储器时插入不必要的等待周期。
3. 理解EMIF仲裁优先级：EMIF的请求源（CPU程序取指、CPU数据访问、EDMA）之间有优先级。默认情况下，EDMA的优先级可能较高。在实时性要求高的系统中，你可能需要调整优先级，确保CPU的关键数据访问不会被EDMA长时间阻塞。这可以通过配置EMIF的SDCCTL（SDRAM控制）寄存器中的相关位来实现。

5.2 应对极端情况：低温启动与高温数据保持

工业或车载环境对温度范围要求很宽（如-40°C到85°C）。SDRAM在极端温度下行为可能异常。

• 低温启动失败：在极低温下，SDRAM内部晶体振荡器可能起振慢，或者电源爬升时间变长。解决方案：
  • 增加上电复位（POR）后的延时：在main()函数最开始，执行SDRAM初始化序列之前，增加一个足够长的软件延时（比如从标准的200us增加到1-2ms），等待电源和时钟完全稳定。
  • 降低初始时钟频率：如果可能，在初始化阶段先以较低的CLKOUT2频率（如一半频率）配置EMIF和SDRAM，完成初始化后再切换到全速。这需要动态调整EMIF的CLKDIV配置。
• 高温数据丢失：高温下，SDRAM存储单元的电荷泄漏加快。如果刷新间隔TREF设置得太极限，可能导致数据在两次刷新之间丢失。
  • 保守设置刷新间隔：不要按照芯片手册的典型值（如64ms）来计算，而是按照最大值（如可能是128ms @ 85°C）来计算，这样在高温下能提供更大的安全裕量。虽然这会略微增加刷新开销，但稳定性更重要。
  • 定期内存巡检与ECC：对于要求极高的系统，可以考虑使用带ECC（错误校验与纠正）功能的SDRAM模块，或者在软件层面实现定期内存巡检（如CRC校验），发现错误及时纠正或报告。

5.3 调试技巧：当逻辑分析仪成为你的眼睛

当软件测试通不过，又怀疑是硬件或底层时序问题时，逻辑分析仪是终极武器。

你需要抓取CLKOUT2、SDRAS、SDCAS、SDWE、BA[1:0]、A[12:0]（部分地址线）以及DQM和ED[31:0]（部分数据线）的信号。设置触发条件为“SDRAS下降沿”（行激活命令开始）。

分析抓到的波形，重点关注：

1. 初始化序列：能看到连续的预充电（SDRAS和SDCAS同时为低，SDWE为低）、自动刷新（SDRAS和SDCAS同时为低，SDWE为高）、模式寄存器设置（SDRAS、SDCAS、SDWE同时为低）命令吗？命令之间的间隔（tRP,tRFC）满足芯片手册要求吗？
2. 正常读写时序：读/写命令发出后，数据在正确的CLK边沿出现在数据总线上吗？tAC（访问时间）满足吗？DQM信号在需要掩码的字节上是否有效？
3. 信号质量：时钟和数据线上有没有过冲、振铃？建立时间和保持时间是否足够？

很多时候，在逻辑分析仪上看到波形，问题就一目了然了，比如命令间隔不够、数据线有毛刺等。

6. 从“读写”到“用好”：在真实DSP项目中的架构思考

最后，跳出单纯的“读写”操作，谈谈在真实的C6713项目中，如何架构性地使用SDRAM。

6.1 内存映射与分区管理

不要将整个SDRAM当作一个混沌的大池子。应该根据项目需求进行逻辑分区。例如：

• 代码区：将不常运行或非关键性能的代码（如初始化代码、诊断程序）从Flash拷贝到SDRAM中运行。注意，在SDRAM中运行代码速度较慢，可能影响实时性。
• 数据缓冲区：这是SDRAM最主要的用途。
  • 输入缓冲区：存放从ADC或外部接口（如McBSP）通过EDMA搬入的原始数据。
  • 处理中间缓冲区：存放算法处理的中间结果，特别是那些尺寸太大无法放入片内L2的矩阵、数组。
  • 输出缓冲区：存放处理完成，等待通过EDMA发送出去（如到DAC或网络）的数据。
• 非易失性数据备份区：如果需要保存一些掉电不丢失的配置或历史数据，可以在SDRAM中划出一块区域，定期将其内容通过EDMA搬运到Flash中。

在链接器命令文件（.cmd文件）中明确定义这些段（SECTION）的存放位置，是良好的工程实践。

6.2 与片内存储器的协同：Cache配置策略

C6713有L1和L2 Cache。如何配置它们与SDRAM的配合至关重要。

• L1 Cache：通常配置为最快的模式。对于频繁访问的指令和数据（如核心算法循环、经常用到的系数表），应尽量锁定在L1或L2中。
• L2 SRAM/Cache：这是性能与容量权衡的关键。你可以将L2全部配置为SRAM（0x000000模式），由软件手动管理关键数据；也可以部分配置为Cache（如0x004000模式，256K Cache + 256K SRAM）。
  • 策略建议：将最核心、访问最频繁的数据段（如实时处理中的当前帧数据）通过#pragma DATA_SECTION指令定位到L2 SRAM部分。将较大的、访问相对不那么频繁的数据（如多帧历史数据）放在SDRAM，并让L2 Cache来加速对它们的访问。
  • Cache行回写（Writeback）与直写（Writethrough）：对于SDRAM中的数据，如果CPU会修改，且需要被EDMA或其他主设备读取，通常使用直写模式更简单（写操作直接更新SDRAM，保持一致性），但性能有损失。如果是一块CPU独占修改、稍后才统一写回的数据，可以用回写模式提升性能，但必须在EDMA读取前手动CACHE_writeback()。

6.3 一个简单的音频处理示例框架

假设一个音频处理项目，采样率48kHz，32位浮点处理，帧大小1024点。

// 在.cmd文件中定义内存区域 MEMORY { ... SDRAM: origin = 0x80000000, length = 0x04000000 // 64MB L2SRAM: origin = 0x00080000, length = 0x00040000 // 256KB 作为SRAM } SECTIONS { ... // 将输入输出双缓冲区和核心系数放在快速的L2 SRAM .input_buf > L2SRAM .output_buf > L2SRAM .coeff > L2SRAM // 将较大的历史数据或FFT旋转因子表放在SDRAM .history_data > SDRAM .twiddle_table > SDRAM // 将非实时性的功能代码（如UI处理）也放在SDRAM .non_critical_code > SDRAM } // 在主程序循环中 while(1) { // 1. EDMA将新一帧音频数据从McBSP（或ADC缓冲）搬运到L2 SRAM的.input_buf start_edma_input(); // 2. 等待EDMA输入完成（或使用中断） wait_for_edma_input_done(); // 3. 从SDRAM的.history_data中加载上一帧的相关数据到L2（如果需要） // 4. 执行核心音频算法（如滤波、FFT），全程在L2 SRAM和寄存器中操作，速度极快 process_audio_frame(); // 5. 将处理结果从.output_buf通过EDMA搬运到McBSP（或DAC缓冲）输出 start_edma_output(); // 6. 将当前帧的某些状态或数据写回SDRAM的.history_data，供下一帧使用 // 注意：如果L2配置了Cache且该区域被Cache，需要先写回 CACHE_writeback(&history_data, sizeof(history_data)); update_history_data(); // 7. 等待EDMA输出完成，准备下一帧 wait_for_edma_output_done(); }

这个框架清晰地展示了SDRAM（大容量、慢速）和片内SRAM（小容量、高速）如何各司其职，通过EDMA进行高效的数据搬运，使得CPU核心能够专注于计算密集型算法，从而在C6713上构建出高性能的实时处理系统。

回过头看那个“SDRAM.rar”，它可能只包含了最基础的EMIF配置代码和读写测试函数。但通过以上这近万字的拆解，你应该能看到，要让SDRAM在C6713这样的DSP上稳定、高效地跑起来，需要考虑的远不止那几行初始化代码。从硬件设计、时序计算、初始化序列、性能优化到系统架构，每一个环节都有细节和坑。希望这份结合了多年踩坑经验的总结，能让你下次再面对“读写SDRAM”这个任务时，心里更有底，手上更有准。

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